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74系列芯片资料

ttl 门使能输入三态输出六同相线驱动器74ls366 ttl 门使能输入三态输出六反相线驱动器74ls367 ttl 4/2线使能输入三态六同相线驱动器74ls368 ttl 4/2线使能输入三态六反相线驱动器74ls37 ttl 开路输出2输入端四与非缓冲器74ls373 ttl 三态同相八d锁存器74ls374 ttl 三态反相八d锁存器74ls375 ttl 4位双稳态锁存器74ls377 ttl 单边输出公共使能八d锁存器74ls378 ttl 单边输出公共使能六d锁存器74ls379 ttl 双边输出公共使能四d锁存器74ls38 ttl 开路输出2输入端四与非缓冲器74ls380 ttl 多功能八进制寄存器74ls39 ttl 开路输出2输入端四与非缓冲器74ls390 ttl 双十进制计数器74ls393 ttl 双四位二进制计数器74ls40 ttl 4输入端双与非缓冲器74ls42 ttl bcd—十进制代码转换器74ls352 ttl 双4选1数据

基于DSP 的PCI 通用运动控制卡的硬件设计

路输出，其中一路如图4 中虚线框(1)所示，其余两路与此类似。xd0~xd7为dsp 的低八位数据线，lm628 所需的32 位数据由其经总线驱动芯片sn74lvc4245 分四个写周期写入。dsp 经cs-1 选通lm628 后，再结合xa0 就可实现对其读写。为了提高控制精度，这里采用12 位输出模式，即在每一个采样周期，lm628 的18~23 脚输出两个周期，前一个输出低6 位数据，后一个输出高6 位数据。为了让12 位数据能同时输入到后续的dac芯片中，这里采用了一片6 位数据锁存器74ls378。当lm628 输出低6 位时，da0 是输入触发器的时钟信号，da1 是触发器的允许信号，此时，锁存器的g 端为高，数据锁存，接着lm628 输出高6 位数据，此时da0 是给dac 芯片的写信号，da1 是片选信号，锁存器的g 端为低，数据不锁存。这样便从8 位输出合成了12 位的dac 输入信号dac0~dac11。 图 4 运动控制卡的一路实现原理图 2.4 数/模转换和放大电路 如图 4 中虚线框(2)所示，dac 参考电压vref 由maxim 公司的max

基于Proteus的远程抄表系统设计与仿真

包括cpu、外围存储模块和数据上传/下载模块，其结构如图3所示。本设计中，cpu选用的是at89c51；外围存储模块选用了串行e2prom的24c02芯片，它是基于i2c-bus 的存储器件，遵循二线制协议，具有接口方便、体积小、数据掉电不挥发等特点，在仪器仪表及工业自动化控制中得到大量的应用。系统设计采用了脉冲抄表的原理，四表都是脉冲式的数字表，主要由霍尔传感器组成。数字表内的感应器每旋转一周，发出一个脉冲，使耗费量和脉冲数成正比，可根据脉冲数来确定用量的具体值。采集模块主要由uln2003、74ls378、7411、cd40174等四个芯片组成，最多可采集6路数据，由于本设计中只采集四表数据，所以有两路悬空未用。 图3 集控器的硬件电路 cd40174芯片的q0～q3分别接至at89c51的p1.0～p1.3。同时，7411芯片产生的负脉冲信号送至单片机的int0，以便有智能终端脉冲产生时，使cpu能产生中断，进行采集。对p1.0～p1.3进行循环查询，则可知采集的脉冲数来自哪个数字表，采集程序流程如图4所示。 图4 采集程序流程图 系统软件系统设计

集成触发器和锁存器

来时，若d＝ i，则触发器置1；若d＝0，则触发器置0，d触发器的特性方程为 d触发器的状态表见表3 图3 d触发器的逻辑符 图3 d触发器的逻辑符 图3所示的d触发器是上升沿触发的，也有下降沿触发的d触发器。d触发器的种类很多，有六上升沿d触发 器74ls174、八d触发器74ls273、六d触发器74ls378等，下面介绍八d触发器74ls273及其应用电路。 （2）八d触发器74ls273 74ls273是具有复位功能、上升沿触发的8位数据锁存器，18个引脚。其功能表见表4，由表可知，当rd＝ 0时，不论cp，d如何变化，触发器可实现异步清零，即触发器为“0”态。当rd＝1时，只有在cp脉冲上升 沿到来时，根据d端的取值决定触发器的状态，如无cp脉冲上升沿到来，无论有无输人数据信号，触发器 保持原状态不变。74ls273的引脚图和所组成的8路数显抢答器如图4所示。 该抢答器能实现优

74系列数字电路74LS378,74F378六D触发器

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74LS378