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基于FPGA的IRIG-B编码器的设计
，对式(2)使用实际的增益和直流偏移，可得式(3)。据此获得查找表。 ck=acsin(2πk／n)+a0 (3) 式中：n=100为采样率；k=0，1，2，…，n-1；ck对应第k次抽样获得的值；a0为保证输出信号为单极性而设置的初始直流偏移；ac为考虑调制比和dac满幅度码值的系数。由于交流信号频率为1 khz，周期为t=1 ms，若在1 ms内将上述抽样值等间隔输出到dac，即可获得1 khz的调制信号。本文使用max5712和单电源rail-rail运放ad8601构成滤波器。在max5712满幅输出时，c=4 095(12 bit dac)，选择调制比为1：5。综合考虑，在最大输出时，不能使dac输出到达运放的上轨，最低输出时，dac输出应高于运放的下轨，所以选取a0=c／2+200=2 248。对应逻辑0，ac=461；对应逻辑1，ac=1 844。根据上述原则计算出的正弦查找表如表1所示。实际使用时，应根据使用dac的解析度、运放的动态范围以及采样率及调制比确定上式中的参数。 4.2.3 dac接口实际使用时应根据dac
组合GPS引擎和FPGA的IRIG-B编码器实现
字调制模块，即可获得交流编码。对正弦信号进行100次等间隔抽样，对式(2)使用实际的增益和直流偏移，可得式(3)。据此获得查找表。式中：n=100为采样率；k=o，1，2，…，n-1；ck对应第k次抽样获得的值；a0为保证输出信号为单极性而设置的初始直流偏移；ac为考虑调制比和dac满幅度码值的系数。由于交流信号频率为1 khz，周期为t=1 ms，若在1 ms内将上述抽样值等间隔输出到dac，即可获得1 khz的调制信号。本文使用max5712和单电源rail-rail运放ad8601构成滤波器。在max5712满幅输出时，c=4 095（12 bit dac），选择调制比为1∶5。综合考虑，在最大输出时，不能使dac输出到达运放的上轨，最低输出时，dac输出应高于运放的下轨，所以选取a0=c／2+200=2 248。对应逻辑0，ac=461；对应逻辑1，ac=1 844。根据上述原则计算出的正弦查找表如表1所示。实际使用时，应根据使用dac的解析度、运放的动态范围以及采样率及调制比确定上式中的参数。 4.2.3 dac接口实际使用时应根据dac的不同，在fp

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低失调电压：500μV(最大值)；单电源操作：2.7～5.5V；放大器低电源电流：750μA；带宽：8MHz；转换率：5V/μs；低失真；无反相位；低输入电流；单位增益稳定

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