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SN65CML100中文资料

  • SN65CML100

    SN65CML100引脚图从LVDS或LVPECL到CIVIL，重复从CIVIL到CML提供电平转换；信令速率高达1.5Gbit/s；CML兼容输出具有3.3V、2.5V或1.8V供电的直接驱动装置；总抖动＜70ps；低100ps(最大值)端口至端口偏斜；广泛的共模接收能力允许直接耦合输入信号；25mV接收器输入阈值迟滞的共模范围超过0～4V；传播延迟时间：最大值800ps；3.3V操作电源；SOIC和MS0P封装

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SN65HVD05P SN65HVD06D SN65HVD07 SN65HVD07P SN65HVD08 SN65HVD08D SN65HVD10 SN65HVD1050D SN65HVD10D SN65HVD10QD

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