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ad582供应商优质现货

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ad582中文资料

  • CPLD在多功能谐波分析仪设计中的应用

    速度。 2.2主要硬件的选择 由于cpld是高速器件,所以在采样频率很高的时候,多路开关和ad转换器就成为制约采样频率的主要因素。当采样频率达到兆级的时候,ram的存储速度又成为了另外一个制约因素。 在本设计中,要求分析的谐波次数达到50次,被测信号在45hz~55hz范围内,频率自动跟随。根据香农定理知:采样频率应该大于或者等于被测信号频率的2倍。要求每个周期采样128点,这样总的采样频率为f=128*55*2=14.08khz,所以采样周期为t=1/fs=71.02μs。采样保持器选择ad582,它是反馈型结构,在精度要求不高(≤0.1%)而速度要求较高时,可选用ch=1000pf,捕捉时间tac≤6μs。多路开关选用max382,它开关速度快,在双电源,连续供电工作方式下,典型开关时间在100ns左右。它的主要特点是:工作电压低、通道电阻小(≤100ω)、具有数字输入锁存、ttl/cmos电平兼容、具有esd静电保护功能等。adc转换器选用max172,该芯片是5v电源供电的12位模数转换芯片,cmos工艺制造,速度快,转换时间为10μs,具有基准源,外接时钟,频率要求为1.25mh

  • CPLD在多功能谐波分析仪设计中的应用

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  • CPLD在多功能谐波分析仪设计中的应用

    2.2主要硬件的选择 由于cpld是高速器件,所以在采样频率很高的时候,多路开关和ad转换器就成为制约采样频率的主要因素。当采样频率达到兆级的时候,ram的存储速度又成为了另外一个制约因素。 在本设计中,要求分析的谐波次数达到50次,被测信号在45hz~55hz范围内,频率自动跟随。根据香农定理知:采样频率应该大于或者等于被测信号频率的2倍。要求每个周期采样128点,这样总的采样频率为f=128*55*2=14.08khz,所以采样周期为t=1/fs=71.02μs。采样保持器选择ad582,它是反馈型结构,在精度要求不高(≤0.1%)而速度要求较高时,可选用ch=1000pf,捕捉时间tac≤6μs。多路开关选用max382,它开关速度快,在双电源,连续供电工作方式下,典型开关时间在100ns左右。它的主要特点是:工作电压低、通道电阻小(≤100ω)、具有数字输入锁存、ttl/cmos电平兼容、具有esd静电保护功能等。adc转换器选用max172,该芯片是5v电源供电的12位模数转换芯片,cmos工艺制造,速度快,转换时间为10μs,具有基准源,外接时钟,频率要求为1.25mh

  • 无二极管峰值保持电路

    输入脉冲经过采样保持放大器(ad582)以及比较器u3。sha输出经过比较器。如果放大器输入脉冲高于sha输出,比较器输出变低,4538单稳态产生10ps的脉冲,反馈形成sha采样,然后保持电压。 来源:zhenglili

ad582替代型号

AD581 AD580 AD578KN AD578 AD5764 AD574AKD AD574AJD AD574A AD574 AD573

AD584 AD585 AD586 AD587 AD588 AD589 AD590 AD590J AD590JH AD590KH

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