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基于ISA总线的多路同步DDS信号源设计
滤波的i、0两路信号输入到该单元电路中，经op-07放大、ad976采集后，再经fpga由isa总线送入到计算机中。op-07具有低偏移、高开环增益的特点，适合于高增益的测试系统应用。ad976是采样速率为200ksps的高速16位低功耗模数转换器。fpga芯片采用ahera公司的acex系列芯片eplk50，实现isa总线与三路dds及数据采集的接口。其灵活的可重新配置特性为实现接口电路提供了极大的方便，片上集成有4okbit的ram，便于缓存计算机的控制信息。dds芯片选择美国模拟器件公司的ad9854。它的相位累加器为48位，利用片上pll可实现4~20倍的可编程倍频，内部最高时钟可达300blhz，尤为突出的优势在于具有100mhz的高速并行配置接口，内置最大相位误差小于1°的i、q两路的dac输出，便于产生lmhz的正交信号。对于该自动测试系统，各路dds之间的同步关系是电路设计的核心问题。ad9854芯片本身没有同步信号，要实现各路的精确同步，必须对电路进行优化设计。为分析方便，分别从参考时钟、刷新时钟和内部锁相倍频三部分进行讨论。 2．1 参考时钟成功的同步设计要求各路
浅谈基于DDS和FPGA技术的高动态扩频信号源
spread spectrum communication）作为一种新型的通信体系，具有抗干扰能力强、截获率低、码分多址、信号隐蔽、保密、易于测距等优点，是通信领域的一个重要发展方向。正是由于这些优点，扩频通信在军事上受到了极大的重视。为配合高动态扩频接收机的研究，迫切需要一台能够精确模拟高机动目标环境条件下的扩频信号的信号源。本文提出的基于dds（direct digital synthesis）和fpga技术的高动态扩频仿真信号源不但能够模拟扩频信号，而且由于采用了使用dds技术的频率合成器ad9854,能够实现高速的频率跳变，因此该信号源就能够比较精确地模拟多普勒效应，实现高动态仿真。由于扩频通信能大大扩展信号的频谱，发送端用扩频码序列进行扩频调制，以及在接收端用相关解调技术，使其具有许多窄带通信难以替代的优良性能，能在民用后，迅速推广到各种公用和专用通信网络之中，主要有以下几项特点：（1）易于重复使用频率，提高了无线频谱利用率；（2）抗干扰性强，误码率低；（3）隐蔽性好，对各种窄带通信系统的干扰很小；（4）可以实现码分多址；（5）抗多径干扰；（6）能精确地定时和
基于DDS的无线数据传输系统设计与实现
信号处理器（mixed signal processor），采用1.8 v~3.6 v 电源电压，在1 mhz 的时钟条件下运行时，芯片的电流在200 μa~400 μa，时钟关断模式的最低功耗只有0.2 μa，在8 mhz 晶体驱动下指令周期为125 ns。且msp430f169 具有丰富的片上外围模块，如看门狗、模拟比较器、定时器、串口、硬件乘法器等。在本系统中，msp430f169 工作在3.3 v 电压、8 mhz 主频下。调制电路以adi 公司单片dds 芯片ad9854 为核心。该芯片最高系统时钟为300 mhz ，理论输出信号频率范围为直流到150 mhz，最高并行编程速率为100 mhz，采用3.3 v 单电源供电，与上述控制器芯片匹配，无需加电平转换电路，从而实现控制器与调制器的无缝接口。 ad9854 支持10 mhz 串行通信方式和100 mhz 并行通信方式，本系统采用串行数据输入方式。ad9854 内置4～20 倍频的pll，外部较低频率的参考时钟可通过倍频后得到300 mhz 的系统时钟，这样就避免了设计高频参考时钟的难度，
基于DDS与USB技术的通信对抗教学演示系统中硬件的设计与实现
ram，rom，双口ram或fifo功能。这使得adexlk适合于复杂逻辑及存储器功能，如数字信号处理、宽域数据路径管理、数据变换和微处理器等各种高性能通信应用。基于可重构cmos sram单元，acex1k结构具有实现一般门阵列宏功能需要的所有特征，相应的多引脚数提供与系统元器件的有效接口。先进的处理功能和2．5 v低电压要求，使得ac2ex1k器件满足廉价、高容量的应用需要。 3．2 dds芯片 dds芯片选用的是美国的analog device inc(adi)公司生产的dds器件ad9854。ad9854数字频率合成器是一个采用了先进的dds技术的高集成器件。他具有一对内部高速、高性能的正交d/a转换器和比较器，可实现数字合成正交的i和q路输出。当输入一准确的参考频率，ad9854即可产生一高稳定的频率、相位、幅度可编程的正弦和余弦信号。ad9854的dds核心具有48 b的频率分辨率。14 b相位截断保证了优良的sfdr指标。ad9854的电路工艺使同步正交信号输出的频率最高达到150 mhz，平均每秒产生1百万新频率。ad9854中4～20整数倍的可编程参考频率累加器能
基于DDS与USB技术的通信对抗教学演示系统中
ram，rom，双口ram或fifo功能。这使得adexlk适合于复杂逻辑及存储器功能，如数字信号处理、宽域数据路径管理、数据变换和微处理器等各种高性能通信应用。基于可重构cmos sram单元，acex1k结构具有实现一般门阵列宏功能需要的所有特征，相应的多引脚数提供与系统元器件的有效接口。先进的处理功能和2．5 v低电压要求，使得ac2ex1k器件满足廉价、高容量的应用需要。 3．2 dds芯片 dds芯片选用的是美国的analog device inc(adi)公司生产的dds器件ad9854。ad9854数字频率合成器是一个采用了先进的dds技术的高集成器件。他具有一对内部高速、高性能的正交d/a转换器和比较器，可实现数字合成正交的i和q路输出。当输入一准确的参考频率，ad9854即可产生一高稳定的频率、相位、幅度可编程的正弦和余弦信号。ad9854的dds核心具有48 b的频率分辨率。14 b相位截断保证了优良的sfdr指标。ad9854的电路工艺使同步正交信号输出的频率最高达到150 mhz，平均每秒产生1百万新频率。ad9854中4～20整数倍的可编程参考频率累加器能使外

基于DDS+PLL频率合成源的设计
摘要：简述了用ddsad9854和pllpe3236所设计的频率合成源的实现方案，重点对硬件设计中的注意事项进行了详细说明，并且对系统的相位噪声和杂散性能做了简要分析。最后给出了系统测试结果。关键词：频率合成器；ad9854；pe3236；相位噪声 frequency synthesizer of dds plus pll qu xinjian12，chang yilin1 (1.xidian university，xi′an，710071，china；2. the 20th research institute of cetc, xi′an，710068，china) abstract：the paper simply presented scheme of frequency synthesizer using ddsa d9854 plus pllpe3236 some cautious problems in hardware design were de scribed in detail, and also simply analyzed phase noise p

AD9854的输出电流问题
ad9854的输出电流问题dds芯片ad9854的输出电流到底是单极性的还是双极性的呢，ad9852的是单极性的，我看adi的设计手册上说ad9854是双极性的，为什么我用示波器看了一下它的输出波形，发现它的波形都在正半轴上呢？
[求助]请大家帮忙推荐几个高频宽带功率放大器件
我做一个射频驱动电路，要做一个50mhz～120mhz内频率近乎连续可调（步进小于500hz）的频率源，信号发生部分我用ad9854加单片机控制给做出来了，但是ad9854的功率输出非常小，电流在5～20ma之间，典型值10ma，输出电压取决于外接电路的阻抗，在-0.5v～+1.0v之间，这样功率输出顶多20mw，而下一级工作器件要求的驱动功率达到了近10w，功率放大了1000倍，而且要求功率放大元件耐压高于40v，耐流大于0.5a。由于我初次接触功率放大方面的电路设计，在网上找了好几天相关的器件也不得要领，几乎没有什么收获。我想求助论坛里的各位大侠，有没有做过功率放大这一块的，给我推荐一些高频的，带宽包含了0～120mhz的功率放大器件。要是有集成的芯片最好，没有集成的就请推荐几个满足要求的高频三极管，如果您能在给予进一步的指导，那就再好不过了。在这里我先谢谢各位大侠了！
有谁知道AD9854的输出功率一般是多大?
有谁知道ad9854的输出功率一般是多大?有谁知道ad9854的输出功率一般是多大?谢谢!
请教高手AD9854的BPSK模式
请教高手ad9854的bpsk模式我在使用ad9854的bpsk模式时，发现相位的变化不是资料上讲的变化的是相位寄存器里设定的相位1和相位2，请问它是怎么工作的？非常感谢！
ad9852 DDS 信号发生器请教？？
谢谢指点，在请教下请教下：c51 和 ad9854 （dds频率器件）串行通信，读写reg不正常，读写奇地址是正常的，但是读写偶数地址的不对，读回来的全是0，奇怪。clk 空闲为1，sdio作为输入输出用，上升沿写入，下降沿读出。不好意思，是ad9854，抱歉。

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基于DDS的无线数据传输系统设计与实现

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请教高手AD9854的BPSK模式

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