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    编译出现错误大家看是什么原因，谢谢-- max+plus ii vhdl template-- clearable loadable enablable counterlibrary ieee;use ieee.std_logic_1164.all;entity atf1508 is port ( clk :in std_logic; count_output :out integer range 0 to 24000000 ); end atf1508 ;architecture a of atf1508 is signal counter: integer range 0 to 24000000; --25bits begin process (clk) begin if (clk'event and clk ='1') then if (counter<24000000) then

  • 关于CPLD的选型

    我一直用atf1508我一直用atf1508

  • 想学习CPLD，准备做一块板，请问用些什么配置？

    想学习cpld，准备做一块板，请问用些什么配置？芯片准备用epm7128,和atmel的atf1508管脚一样，不知道有没有更好的芯片，这块芯片是不是做时序逻辑不太方便？语言哪种比较好？verilog hdl还是vhdl?据说vhdl复杂，不知道用过的人怎么看？板上做一些什么外围电路呢？最好是做一些cpld的经典应用，因为我是做单片机的

  • 老耿师傅，从你那卖了机片ATF1508转换软件在何处有下载的

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  • 请教 ATF1504，ATF1508 的加密方法,是否直接写入就行?

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