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BELLING
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BELLING [SHANGHAI BELLING CO., LTD.]
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参考意见一、原理图说明图示为加入抗干扰保护的电路设计1，bl55021的第9（cs）、11（wr）、12（data）引脚为常用信号线。第10（rd）引脚在需要读取bl55021内部数据时使用，为增加抗干扰能力，建议在不影响mcu负担的情况下保留使用（详见第三部分）。2，r1、r2、r3、r4为上拉电阻；r10、r20、r30、r40为抑制高频信号电阻；c11、c12、c13、c14为去耦电容；在信号良好的情况下可省略，系统需强化抗干扰能力时可调试使用。3，c1、c2为电源滤波和去耦电容。c1为瓷片电容、c2为电接电容，布线时应尽量靠近bl55021---vdd引脚，增强对干扰抑制能力，在信号良好的情况下可省略。4，r5为vlcd分压电阻。vlcd与gnd之间的压差为液晶屏工作电压。当bl55021---vdd与液晶屏工作电压相同时，可短接vlcd与vdd。5，osci与osco为时钟输入脚，接法见图示。osci与1~4组白色相连，osco与同组绿色相连。当选用内部时钟时，两个引脚都悬空。当选用晶体时，osco引脚需要与gnd之间接一20 pf的电容。6，irq可根据需要作为时钟输出。7，bz可外界压
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