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德州仪器CDCD5704时钟发生器用于存储器时钟
ti(德州仪器)日前发布的cdcd5704时钟发生器可借助带或不带扩频调制功能的参考时钟输入，提供支持xdr存储器子系统与redwood逻辑接口所必需的时钟信号。cdcd5704采用28引脚tssop封装，其中包含4个差动时钟输出，能够为各种高性能接口应用提供现成的解决方案。 cdcd5704的主要组件包括一个锁相环、一个旁路多路复用器以及4个差动输出缓冲器(clk0至clk3)。en引脚输入端的逻辑低电平可禁用所有4个输出。当en为高电平且串行接口寄存器(rega-regd)的值为1时，就会启用输出。 pll可接收参考时钟输入信号refclk，并在频率等于输入频率与乘法系数之积的条件下输出时钟信号。将pll输出时钟信号馈送至差动输出缓冲器，以驱动启用的时钟。另外将禁用的输出设置为高阻抗。旁路模式可以绕过pll，将输入时钟refclk路由至差动输出缓冲器。为了确保cdcd5704时钟发生器始终正确运行，一旦时钟输入低于10mhz，器件就会关闭pll，并将输出置于高阻抗状态。如果电源电压vdd小于vpuc，则复位所有逻辑栅极、断开pll电源，同时将输出置于高阻抗状
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