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基于PSoC3 UDB的异步SRAM读写控制
摘要：本文介绍使用cypress的psoc3 udb实现对异步sram的读写控制，并以cy7c1069av33 sram为例介绍其软硬件设计过程。 1, 概述 cypress psoc3使用基于单循环流水线的高性能8051内核（67mhz/33mips），提供业界广泛采用的5.5v至0.5v电压范围和低至200na的休眠电流，可以满足极低功耗的应用场合。psoc3的高性能模拟子系统和数字系统都拥有可编程通路，允许将任何模拟或数字信号（包括可编程时钟）分配到任何通用i/o引脚，这为使用者提供了真正的"系统级"可编程能力。 psoc3中sram的容量最大为12kb（3个4kb块），8051cpu和dma控制器均可访问sram.如果访问不同的4kb块，8051和dma控制器可同时访问sram.图1为psoc3访问片上sram框图。图1,psoc3访问片上sram psoc3同时也提供了外部存储器接口（external memory interface, emif）用来连接外部的存储器设备。它与udb、i/o端口和其他硬件产生外部存储器地址和控制信号。emif支持同步和异步存储

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