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CPLD与绝对式编码器高速通信在高精度高速伺服单元中的应用
的直流电压转变成+3.3v稳定直流电压供给cpld使用，tps7333转换效率、可靠性和稳压性都比较好，它在输入电压为+3.77v~+10v的电压范围内都能转换出+3.3v，使cpld不受输入电压过高导致其烧坏。cpld及其外围电路模块 cpld及其外围电路模块主要由cpld、cpld编程下载接口电路(jtag接口)、dsp接口电路、有源晶振、电平转换电路和adm485及其外围电路(负责与编码器通信的接口电路)组成(图2)。图2 硬件整体结构框图本设计cpld采用altera公司的epm570t144c5，此芯片属于altera公司的max ii，max ii相对max i成本更加低，功耗更加小，而器件的宏单元数更加多，且器件延时控制在6ns以内，具有很高的性价比。epm570t144c5有570个宏单元数，芯片的引脚数目为144个，其中可用的i/o口有116个，因此此芯片的资源已经足够用。cpld主要负责与绝对式编码器的高速串行通信，并受控于dsp的命令把接收到编码器数据和其他信息并行的转送给dsp。 jtag接口主要用于下载可执行文件到cpld，在pc机安装altera公司的开发环境—
CPLD与绝对式编码器在高精度高速伺服单元中的应用
流电压转变成+3.3v的稳定直流电压供给cpld使用，tps7333转换效率、可靠性和稳压性都比较好，它在输入电压为+3.77v-+10v的电压范围内都能转换出+3.3v，使cpld不受输入电压过高导致其烧坏。 cpld及其外围电路模块 cpld及其外围电路模块主要由cpld、cpld编程下载接口电路（jtag接口），dsp接口电路、有源晶振、电平转换电路和adm485及其外围电路（负责与编码器通信的接口电路）组成（图2）。本设计cpld采用altera公司的epm570t144c5，此芯片属于altera公司的max ii，max ii相对max i成本更加低，功耗更加小，而器件的宏单元数更加多，且器件延时控制在6ns以内，具有很高的性价比，epm570t144c5有570个宏单元数，芯片的引脚数目为144个，其中可用的i/o口有116个，因此此芯片的资源已经足够用。cpld主要负责与绝对式编码器的高速串行通信，并受控于dsp的命令把接收到编码器数据和其他信息并行的转送给dsp。 jtag接口主要用于下载可执行文件到cpld，在pc机安装altera公司的开发环境-
CPLD在双轴位置检测系统中的应用
补这些缺陷。 2 cpld简介和器件选型利用可编程逻辑器件cpld(complex programable logic device)设计硬件系统非常方便。工程师通过传统的原理图输入法，或是硬件描述语言自由设计数字系统。通过软件仿真验证事先设计的正确性。在pcb完成后，还可利用cpld在线修改能力，随时修改设计而不必改动硬件电路。因此，使用cpld可大大加快硬件电路设计进程，减少pcb面积，提高系统可靠性。根据所需逻辑门数量以及将与其连接的电路引脚数，选用altera公司的epm570t144c5型cpld，该器件采用tqfp144封装，内部有570个逻辑单元，相当于440个宏单元，而此前常用的epm7128只有128个宏单元。 epm570t144c5内部有2个i／o分区，共116个通用i／o，引脚延时为8．8 ns，满足位置检测系统所需的90多个通用i／o和延时不超过10 ns的设计要求。 3 位置检测系统组成在介绍位置检测系统前，先简要介绍伺服电机控制系统(图1)。cpld先对伺服电机光电编码器上发出的反馈信号进行译码、四倍频鉴相计数，然后将计数值存入锁存器，当

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