当前位置:维库电子市场网>IC>isp1501 更新时间:2026-04-11 18:47:15

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isp1501价格行情

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历史最低报价:¥8.5000 历史最高报价:¥40.0000 历史平均报价:¥20.9166

isp1501中文资料

  • 基于FPGA的USB2.0控制器设计

    dr[17];usb_mem_sel <=addr[17];第18位地址addr[17]为高时选择缓冲存储器,否则选择内部寄存器。地址addr[16:2]直接用于存储器ssram的地址。2.1 utmi接口utmi接口信号包括:与发送数据相关的信号(txvalid、txready等),与接收数据相关的信号(rxactive、rxvalid、rxerror等)以及16位双向数据线。 在物理层,该控制器需要一个外部的usb收发器(transceiver),本文采用的是philips公司的isp1501芯片。该芯片用作usb2.0的模拟前端,从usb电缆来的差分信号进行反转不归零码(nrzi)解码和位解填充转换成16位并行数据;反之,16位并行数据通过一个差分驱动电路经过串行化、位填充和nrzi编码输出到usb电缆上。isp1501通过管脚mode0和mode1决定收发器的工作模式,共有4种工作模式:mode[1:0]为“00”时,收发器处于断开状态;为“01”时处于全速(full speed)模式(此时usb带宽为12mb/s);为“10”时是高速(high speed)模式(此时usb最大

  • 一种高速USB设备控制器IP核的设计与实现

    整个控制逻辑,把整个设备端控制器核划成6 大块:物理层phy,收发器宏单元接口utmi,协议层pl,存储接口仲裁mia , 内部状态控制寄存器csr 以及端点存储dpram,如图2(b)所示。 3.2.1 phy 由usb2.0 协议规范可知, 高速设备控制器必须能在高/全速信号环境之间正确切换, 因此phy必须能够根据工作模式确定其信号环境;其次必须进行高速480m/全速12 mhz 的nrzi 数据流解码、编码工作及其相应的串并、并串转换。设计中phy使用了philips 的isp1501, 因此该部分数模混合设计不做介绍,isp1501 的详情请参考文献。 3.2.2 utmi utmi 控制suspend/resume 的产生以及生成全/高速之间切换的模式信号, 由于isp1501 的数据线宽度为16 bits,一次处理一个字(1 word=2 bytes),故还要起到phy 与协议层(pl)之间数据交换的缓冲作用。内部框架如图3 所示。速度协商控制(snc)为该模块的核心。 3.2.3 pl 协议层模块是整个sie 的核心,控制着整个数据传输

isp1501替代型号

ISP1362BD ISP1362 ISP1301 ISP1181 ISP1161BM ISP1161A1 ISP1161A ISP1161 ISP1160BM ISP1160/01

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