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基于高速传输技术的0FDM系统设计
sk调制解调。本系统丰要由4部分组成：dsp、fpga、正交数字上变频器(quadrature digital upconverter)、正交数字下变频器(quadrature digital downconverter)。系统硬件结构如图2所示。图中，d表示数据总线，a表示地址总线，c表示控制总线，l表示链路口数据线，字母后面的数字表示总线的位数。50 mhz晶振为两片dsp及fpga提供时钟信号，32．768 mhz高稳定度品振为ad9857和ad6654提供高质最的时钟信号。复位芯片max6708控制dsp、fpga、ad9857、ad6654和 stl6c550的复位。 dsp完成qam或qpsk的调制解调和fft／ifft变换。系统所使用的dsp是adi公司的tiger sharctslol。该dsp具有以下特性：最高工作频率为300mhz，3．3ns指令周期；6mb片内sram；2个计算模块，每个模块都有1个 alu、1个乘法器、1个移位寄存器和1个寄存器组；2个整型alu，用来提供寻址和指针操作；14个dma控制器；1149．1 ieee jtag口。对于0fdm基带处理，该
基于高速传输技术的OFDM系统设计
本系统主要由4部分组成： dsp、fpga、正交数字上变频器（quadrature digital upconverter）、正交数字下变频器（quadrature digital downconverter）。系统硬件结构如图2所示。图中，d表示数据总线，a表示地址总线，c表示控制总线， l表示链路口数据线，字母后面的数字表示总线的位数。50 mhz晶振为两片dsp及fpga提供时钟信号，32.768 mhz高稳定度晶振为ad9857和ad6654提供高质量的时钟信号。复位芯片max6708控制dsp、fpga、ad9857、ad6654和st16c550的复位。图2系统硬件结构 dsp完成qam或qpsk的调制解调和fft/ifft变换。系统所使用的dsp[2]是adi公司的tiger sharc ts101。该dsp具有以下特性：最高工作频率为300 mhz，3.3 ns指令周期；6 mb片内sram；2个计算模块，每个模块都有1个alu、1个乘法器、1个移位寄存器和1个寄存器组；2个整型alu，用来提供寻址和指针操作；