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结构:双口ram结构、fif0结构、乒乓缓存结构。前两种缓冲结构的存储容量相对较小,不是特别适合高速图像处理系统。乒乓缓存结构的特点决定了可以用相对较便宜的高速大容量sram、外围逻辑器件构成比双口ram以及高速fifo更适合视频处理系统所需要的缓冲存储器。采用cpld控制两块sram以乒乓方式工作,实现数据流在系统中的高速传输。 3.1 视频采集的工作流程 视频采集的硬件框图如图2所示。系统复位后,单片机(mcu)通过i2c总线对saa7114h初始化。单片机采用philips公司的p89c61x2bn,具有在系统编程功能,允许更改saa7114h初始化程序,并可烧写到单片机flash中,相当方便。初始化成功后,saa7114h开始工作,将输入的模拟视频信号转换成720×576的yuv422数字信号,然后输入cpld。cpld一方面进行格式转换,输出yuv4:1:1、cif。格式的数字信号,另一方面还作为地址发生器,与cif、格式数据一起输入到sram。cpld还产生sram的读写控制信号,使用两片sram,以乒乓方式工作,每片保存一场图像。图2中指向da[7:0]的实线箭头与指向db[7:o
p89c54x2bn dip 9.8 p89c54x2ba plcc 10.0 otp p87c58x2bn dip 18.7 p87c58x2ba plcc 19.5 flash om4368bn dip 14.0 om4358ba plcc 18.0 p89c58ba plcc 15.2 p89c58x2fa plcc 15.2 p89c58x2fn dip 15.2 flash p89c60x2bp dip 19.2 p89c60x2ba plcc 19.2 p89c61x2bn dip 19.8 p89c61x2ba plcc 19.8 otp p87c51rb2fn dip 32.0 p87c51rc+jn dip(工) 23.0 p87c51rc+ja plcc(工) 23.0 p87c51rd2ba plcc 33.0 flash p89c51ra2bn dip 7.8 p89c51ra2ba plcc 8.2 p89c51rd2bn dip 31.0 p89c51rd2fn dip 32.0 p89v51rd2fbc lqfp 27.5 p89