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，它是一个数字锁相环，可对选择器b输出的高级别时钟进行同步，从而输出稳定的时钟t0，t0为满足g．812要求，为sdh设备内各部分提供系统时钟信号，从而实现网同步；同时，设备还具有向其他sdh设备提供定时信号功能，这部分功能由选择器c来实现，选择器c从t0和选择器a中选择最优时钟，经过锁相环处理，最后输出满足g．813要求的定时信号t4。 4 锁相环在sdh设备中的应用 由上述分析可知，设备中有两处用到了锁相环，一处是系统同步时钟锁相环，另一处是导出时钟锁相环。 上半部分的锁相环为setg，足一个数字锁相环，其中数字lf由cpu软件实现，pd由fpga实现；pd对由选择器b选择出来的定时基准信号和vco分频产生的信号进行数字鉴相，经过cpu滤波处理和d／a转换产生一个控制电压，从而对vco进行频率控制，由此构成一个反馈回路，当定时基准的频率以及抖动漂移性能在一定范围之内时，最终本地vco能同步到定时基准。框图的下半部分为输出时钟的锁相环，是一个模拟锁相环，不涉及软件的控制，其原理和数字锁相环相同，最终也输出锁定于输入的稳定的时钟信号，为其他sdh设备的时钟输入。 5 锁相环特性
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