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sn65lvds95供应商优质现货

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sn65lvds95价格行情

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历史最低报价:¥15.0000 历史最高报价:¥15.0000 历史平均报价:¥15.0000

sn65lvds95中文资料

  • 在FPGA中实现源同步LVDS接收正确字对齐

    比如8b/10b编码中k28.5码型的主要功能就是字对齐处理。发送端在有效数据中插入k28.5码型,接收端在收到的数据中寻k28.5码型,找到之后以这个码型为参考得到正确的并行数据输出。此外,诸如sdh协议就利用帧头位置的a1a2字节来进行字对齐处理。 另外一些相对低速的lvds接口也利用低频的源同步时钟来携带字对齐信息,以便在接收端实现正确的数据恢复。这里的低频源同步时钟也如图1中的随路时钟,lvds数据和随路时钟之间的倍数关系通常等于lvds串行化时的倍数因子。比如,德州仪器(ti)的sn65lvds95 lvds发送器,不仅可完成21:3的lvds串行化发送,还将21位的并行数据和时钟串行化成3路lvds数据输出和1路时钟输出。串行化因子的值等于7,所以输出时钟的频率是lvds数据速率的七分之一。通过这个随路时钟,配套的解串器sn65lvds96就能够正确恢复并行数据。 与这类单独的lvds serdes器件相比,fpga集成lvds模块能提供更高的集成度,并简化硬件设计、节省pcb面积,从而降低应用成本。高端fpga还在i/o单元里固化了lvds串行器/解串器,支持非常高的速率,比如a

  • SN65LVDS95DGG的技术参数

    产品型号:SN65LVDS95DGG
    并行输出数:-
    并行输入数:21
    数据吞吐量(Mbps):170.630
    串行数据接收通道:-
    串行数据发送通道:3
    线路类型:LVDS
    驱动(RL)(Ω):90
    工作电压(V):3.300
    接收tpd(ns):-
    工作电流ICC(mA):110<...

  • SN65LVDS95

    SN65LVDS95引脚图每秒吞吐量高达1.428Gbit/s的3:21数据通道压缩;适合具有非常低EMI的点对点通信子系统;具有低电压TTL时钟输入的21个数据通道,具有低电压差分时钟输出的3个数据通道,可选时钟的上升沿触发输入;总线引脚不支持6kVHBMESD;单一的3.3V电源和250mW(典型值)操作;5V容错数据输入;具有20mil端口间距的薄收缩型小外形封装;当禁用时,损耗<1mW;宽的锁相输入频率范围:20~68MHz;锁相环无需外部元件;输出达到或超过规定的ANSIEIA/TIA-644标准;工业温度合格TA=-40~85℃;可替换DS90CR215

sn65lvds95替代型号

SN65LVDS94DGG SN65LVDS94 SN65LVDS93DGG SN65LVDS93 SN65LVDS391 SN65LVDS390PWR SN65LVDS390PW SN65LVDS390D SN65LVDS389 SN65LVDS3486BD

SN65LVDS95DGG SN65LVDS96 SN65LVDS9637BD SN65LVDS9637BDR SN65LVDT100 SN65LVDT122 SN65LVDT122PWRG4 SN65LVDT2 SN65LVDT250 SN65LVDT386DGG

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