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应用于NiosII的SOPC中EEPROM Controller Core的设计
opc builder集成在eda工具quartusii中，提供了niosii处理器及一些常用外设接口，如dma控制器, sdram控制器，spi接口以及锁相环pll等等，对于一些库中没有提供的模块用户可以自己定义添加。在实际应用中，具有i2c接口的eeprom有着广泛的运用，本文就是在基于niosii的sopc中设计了一个eeprom controller core，用verilog hdl描述硬件逻辑部分，同时编写相关驱动，下载到stratix系列的 fpga中实现了对片外eeprom a t24c02的读写。 2 基于niosii的controller core sopc中的各模块通过altera公司开发的avalon总线互连。任何一个挂接在avalon总线上的模块都必须符合avalon总线规范，即包含特定的信号类型clk，reset，chipselect，write，writedata等，并满足一定建立保持时间和等待周期的读写模式。一个典型模块的controller core由硬件和驱动软件两部分构成。 2.1硬件构成基于
基于AT89C51的密码电源开关设计
9c51 是intel 公司的一款集cpu 、ram、rom、i/ o 接口、定时器/ 计数器、中断系统为一体的单片机, 片上带有4 k 的rom 和128 ×8 位的ram。系统中按键采用查询方法与单片机连接,可以实现输入正确密码开电源,输入正确密码关电源,修改密码,修改延时等功能。8 路继电器全部连接在p0口,通过p0口的电平变化来控制继电器,进而控制电源的开关,为了节省端口,l ed 显示连在普通口,因为要在关电后保证密码不丢失,利用i2 c 技术在单片机外部扩展了一个e2 prom(a t24c02) ,来存储正确的密码。单片机最小系统如图2 所示,89c51 的外部通过18 ,19 脚连接一个晶振和两个电容,构成振荡电路,可以为单片机提供时钟频率。9 脚通过一个10kω 电阻和一个10μf 的电容构成了一个简单的复位电路, ea 接高电平,al e、psen 信号不用,这样就构成了一个单片机最小系统。这个最小系统未设复位键,系统加电时自动复位。继电器电路本系统中要实现用弱电去控制强电,所以我们使用了继电器,用以对电源通断的控制,如图3

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