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步进电机的控制电路图
如图是步进电机的控制电路。其中，图（b）是步进电机控制电路框图，电路中，时钟发生电路采用晶振和锁相环，通过可编程除法器tc9122p的分频比n与比较频率得到时钟频率，若分频比设为10～999，则压控振荡器vco的振荡频率为10～999 khz。vco的输出频率对应于通过tc9122p的10、100和1000分频得到的1～99.9 khz、100hz～9.99 khz、10～999 hz宽范围的时钟频率。时钟信号通过步进电机控制器td62803p变为加到各相绕组的脉冲，该脉冲经晶体管放大，驱动几a数量级的步进电机使其运行。图（c）是锁相环pll用4046的内部电路框图，片内有2个相位比较器，但用对频率与相位进行比较的pc2对基准信号与进行n分频的时钟脉冲进行比较。图（d）是4046的基本使用方法，vco的最低振荡频率和最高振荡频率可按下式求出：式中，cx为vco的固有电容，容量为32 pf。图（e）和图（f）是tc9122p的管脚配置与内部等效电路框图。tc9122p是一种用bcd码设定的可编程除法器，分频比n可设定为8～3999，但作为pll电路的可编程除法器
PLL脉冲发生器(74HC4060、TC9122P)
如图所示为pll脉冲发生电路。该电路为锁相环(pll)脉冲发生器电路。锁相环对晶振进行分频得1khz信号作为步进频率，在输出端获得10khz 999khz的脉冲波形。集成块74hc4060是内部具有非门和1/2n分频电路的集成芯片，其中，非门与频率为4.096mhz晶振构成振荡电路，分频电路对此进行分频获得lkhz基准频率的信号。tc9122p是高速可编程计数器，其分频比由bcd码决定，由编程数据决定的分频比范围为8～999，本电路工作在10～999的分频比上。74hc4060内部有3种相位比较器，其中相位比较器pc2把输出频率同基准频率的正沿进行比较，从而控制其反馈。vc0的振荡频率由cx、r1和r2决定，其最低、最高频率为：。来源:university
PLL脉冲发生器(74HC4060、TC9122P)电路图
如图所示为pll脉冲发生电路。该电路为锁相环(pll)脉冲发生器电路。锁相环对晶振进行分频得1khz信号作为步进频率，在输出端获得10khz 999khz的脉冲波形。集成块74hc4060是内部具有非门和1/2n分频电路的集成芯片，其中，非门与频率为4.096mhz晶振构成振荡电路，分频电路对此进行分频获得lkhz基准频率的信号。tc9122p是高速可编程计数器，其分频比由bcd码决定，由编程数据决定的分频比范围为8～999，本电路工作在10～999的分频比上。74hc4060内部有3种相位比较器，其中相位比较器pc2把输出频率同基准频率的正沿进行比较，从而控制其反馈。vc0的振荡频率由cx、r1和r2决定，其最低、最高频率为：来源:university
TV信号转VGA信号电路图
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那位大哥能帮我找找一些锁相环频率合成的资料啊
那位大哥能帮我找找一些锁相环频率合成的资料啊那位大哥能帮我找找一些锁相环频率合成的资料啊？我在做毕业设计，老师要求用cd4046芯片产生带小数的频率，例如100.2khz，我想用双环来实现，苦于手头资料太少，所以请大家帮我找找这方面的资料，一些电路图纸或设计思路，希望大家给点意见，感激不尽。。。顺便帮我找找tc9122p这个芯片的资料，小弟我找了很久都没找到。。谢谢

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