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芯片满足dvi1.0规范,最高支持1 600×1 200分辨率,支持24位真彩色视频。另外考虑到机载视频信号源与dvi接收器之间距离较远,长线传输时信号的高频分量比低频分量衰减得更多,因此在dvi输入信号解码前加入均衡器以实现频谱的均衡化,减小信号失真。系统采用美国国家半导体公司的ds16ev5110实现dvi视频信号的频谱均衡化,该芯片可以对dvi视频信号的每一数据通道设定不同的均衡增益,具有高度的灵活性,可以有效减小信号的码间串扰。 系统的dvi视频输出功能采用ti公司的dvi编码芯片tfp410实现,该芯片满足dvi1.0规范,最高支持1 600×1 200分辨率,支持24位真彩色视频。 2.4 pal视频编解码模块设计 为便于pal视频信号的长线传输,系统采用差分信号传输pal视频。由于标准的pal信号为单端信号,因此系统在pal信号接收端采用美国ad公司的差分接收放大器ad8130来实现差分pal信号转换成标准单端pal信号,而在pal信号发送端则采用ad公司的高速差分驱动器ad8131实现单端pal信号转换成差分信号。 系统采用ad公司的pal解码芯片adv71
述的基于功率谱的频域函数与其他方法的清晰度*价函数对比结果。由图可以看出基于功率谱的图像清晰度*价函数具有较好的*判本领。 2 系统框图 基于fpga的自动调焦系统框图,如图4所示。其中图像的预处理过程,清晰度*价函数的算法实现过程,以及控制电机的算法实现和调焦过程都在fpga中实现,并且进行实时处理。该模块共包含了5个模块3个部分,3个部分分别是输入端、处理过程和输出端。在处理过程中增加了sdrm与。flash芯片。输入输出采用dvi接口,它们分别为tfp401输入dvi芯片和tfp410输出dvi芯片。fpga核心处理芯片选用cyclone3ep3-c5f256c8n芯片,其中包含10万个逻辑门,同时给图像数据提供缓冲使用2片is4232400。 由式(4)可知,对于一幅640×480的灰度图像,需要经过1 228 800次乘法运算,307 200次开方运算,* 400次加法运算。由于计算量特别大,而且每一幅图像的变化不大,所以本系统采取了将图像划分为128×64大小的5个模块,首先对28×64大小的灰度图像进行傅里叶变换,然后获得图像的功率谱,再对其信号值进行加权,
只看到左边的图像,右眼只看到右边的图像时就能看到立体图像。一种基于液晶和视差原理的自由立体显示器,将左右图像分别放在亚像素列的偶数列和奇数列。合成后的效果如图1(b)所示,左右图像的亚像素在水平方向间隔排列。 1.2 硬件系统设计 系统的硬件框图如图2所示。该系统采用dvi作为视频输入输出接口。dvi作为一种全数字的接口标准,已经成为液晶显示器必备的一种接口。与vga相比,它的优点在于采用数字信号传输,没有a/d、d/a二次转换带来的信号损失。其中输入输出分别采用ti公司的tfp401和tfp410芯片,该芯片支持最高165 mhz的像素时钟,即对应1 600×1 200@60 hz的分辨率。fpga芯片采用xilinx公司的spartan3e系列的xc3s1600e,该芯片具有较为丰富的资源,并且成本较低。为了满足视频数据存储的需要,该系统还配备了一组位宽为32 bit、容量为64 mb的ddr sdram存储芯片。该设计利用dvi输入输出时序上的特点,分时利用一组sdram实现了类似“乒乓操作”的帧缓存功能,充分利用了系统资源。 2 fpga逻辑设计 系统设计的主要任务是完成f
电源管理功能(动态电压缩放、smartreflex技术)。smartreflex 技术通过专用高速跨集成电路 (i2c) 链接进行控制; - 控制更多功率资源的激活(外部 ldo)。 ● 系统管理 tps65950 的工作模式和状态通过高速 i2c 配置接口的寄存器存取完全控制。此外,tps65950 还可实施: - 几个函数中断,能路由到一两个目标; - 内外部信号监控,软件或硬件可发出模数转换请求; - 数字权利管理的安全软件访问协议。 模拟 tfp410 是一款符合 dvi 1.0 标准的数字发送器(dvi am 方框图如图7所示),支持 vga 到 uxga 的 24 位真彩像素格式显示分辨率。这种通用接口的优势包括:可选总线宽度、可调信号大小以及差动和单端时钟等。电压在 1.1v ~ 1.8v 之间调节的数字接口可提供低 emi 与高速总线,与 12 位或 24 位接口实现无缝连接。如果系统中使用 lcd 显示屏,则应考虑 lcd 电源、led 背光以及触摸屏控制器等问题。tsc2046 是一款具有 2.5v 片上参照电压的四线触摸屏控制器
符合数字视觉接口(DVI);支持分辨率从VGA到UXGA(orL0~165MHz像素率);通用图形控制器接口:12位双边缘和24位单边缘输人模式,可调1.1~1,8V和标准3.3VCM0S输人信号电平,全差分和单端输人时序模式;加强锁相环噪声抗扰:片上监管和绕行电容器可降低系统成本;力口强抖动性能:无HSYNL数据抖动;可编程采用12C串行接口;监测检测通过热插拔和接收器检测;单3.3V电源操作;TI先进的0.18μmEPIC-5TMCMOS处理技术;引脚兼容SiI64DVI发射器
关于dm642的dvi接口各位达人,本人毕业设计要做一个dvi的出口,从dm642引出来,选用ti的tfp410,但是现在不敢画电路图,找了半天也没有参考的电路,各位有没有知道的提点一下,谢谢。