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-px光接口要求的epon光收发模块，但只使用光接收部分。千兆以太网收发器芯片则采用商用芯片，它完成比特同步和串/并变换功能，然后将并行数据通过10比特接口（tbi）输出给epon测试仪核心功能现场可编程门阵列（fpga）来处理。 核心功能fpga完成底层硬件平台的核心处理功能，包括epon协议帧的采集、epon链路参数统计和用户配置等，综合考虑这些功能对fpga的资源需求、可扩展性和低成本要求，我们选择的是altera公司的stratix系列芯片。 百兆物理层（phy）芯片采用的是vt6108s，它实现核心功能fpga与软件控制台的接口功能。由于核心功能fpga采集数据的峰值速率可达千兆速率，而输出给控制台时仅为百兆速率，故使用一个外部静态存储器（sram）实现输出数据的缓存。 3.2 核心功能的fpga设计 3.2.1 epon协议帧的采集 图4是上/下行协议帧采集框图。千兆收发器芯片通过tbi接口将epon上/下行链路的数据送给核心功能fpga，fpga以异步先入先出（fifo）方式将接收到的数据同步到fpga内部的125 mhz时钟，然后进行8b/10b解
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