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DS-SS接收机全数字AGC的FPGA实现
作时，输入信号变化的动态范围高达100db。在发射机距离工作时（几百米），接收机所接收的信号功率就会出现超出射频前端芯片动态范围的情况，这会使射频前端内部的agc失去作用，致使输出信号幅度不恒定，且有可能因为输入信号过大而烧毁放大器。避免上述情况，本文提出了通过增加一个数控衰减器和外部agc系统来保证整个接收系统具有100db的动态范围，并给出基于fpga的电路实现算法。该ds-ss接收机系统构成如图1所示。其中射频前端采用nemerix公司的nj1004芯片，数控衰减器采用m/a-com公司的at90-0106。1 外部agc原理和设计接收机的接收信号经过滤波器、放大器1和下变频器处理后，载波频率变为1575.42mhz，再经过数控衰减器和放大器2进入射频前端。在射频前端，nj1004芯片内部对输入信号经过下边频、滤波、放大和ad采样后，输出sgn和mag两路中频数字信号，ad采样位数为2bit，采样率为16.368mhz，中频信号频率为4.092mhz。射频前端nj1004内部含有一个agc系统，其动态范围为60db。输入信号在射频前端的动态范围内变化时，sgn输出信号的占空比恒定为50%，mag输

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