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14 Bit Digital to Analog Converter 1...
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14-Bit, 165MSPS SpeedPlus(TM) DAC Sc...
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性质可知，输入g(n)的响应v(n)为：。同理，输入g*(n)的输出v*(n)是v(n)的复共轭。于是得到输出y(n)的表达式： 因此，输出信号和输入信号是频率相同的正弦波，仅有2点不同：1 振幅被加权，即网络系统在ω=ω0的幅度函数值；2 输出信号的相位相当于输入有一个q(ω0)时延，即网络系统在ω=ω0的相位值。该方案幅度和相位测量的控制都通过fpga实现，能够使测量结果精确。 1．2 系统总体设计框图 系统通过键盘扫描得到外界设置的扫频范围和频率步进，通过调用dds控模块控制dac904，输出扫频信号。由于信号在被测网络阻带内会有很大的衰减，故用程控放大处理经被测网络的扫频信号之后，利用ad637进行有效值采样，lm311进行整形。信号有效值经maxl270进行ad转换后得到有效值的数字量，整形后的信号经测相模块处理得到相位差值。在fpga中写入2个ram存放被测信号的有效值和相位差值。完成一次扫频后通过波形显示模块将幅频、相频曲线显示在示波器上，并将特定频率点的幅度和相位差值在液晶显示器上进行显示。系统实现框图如图1所示。 2 系统功能部分设计 2.1 扫频信号的
：，式中，。对于输入为，线性时不变系统稳态输出为。根据线性性质可知，输入g（n）的响应v（n）为：。同理，输入g*（n）的输出v*（n）是v（n）的复共轭。于是得到输出y（n）的表达式： 因此。输出信号和输入信号是频率相同的正弦波，仅有2点不同：1）振幅被加权，即网络系统在ω=ω0的幅度函数值；2）输出信号的相位相当于输入有一个q（ω0）时延，即网络系统在ω=ω0的相位值。 1.2 系统总体设计框图 系统通过键盘扫描得到外界设置的扫频范围和频率步进，通过调用dds控模块控制dac904，输出扫频信号。由于信号在被测网络阻带内会有很大的衰减，故用程控放大处理经被测网络的扫频信号之后，利用ad637进行有效值采样，lm311进行整形。系统实现框图如图1所示。 2 系统功能部分设计 2.1 扫频信号的产生 直接数字合成（ddfs）信号源。它是一种完全数字化的方法：先将一个周期的正弦波（或者其他波形）的离散样点幅值的数字量预先存储于rom或者ram中，按一定的地址增量间隔读出，经d／a转换后成为不同频率的模拟正弦波信号波形，再经低通滤掉毛刺即可得到所需频率的输入信号。按
随器、模拟开关和电容搭建采样与保持电路。射极跟随器可选用带宽稳定且带动容性负载强的运放，有较多的ti模拟开关，使其速度很容易满足要求，再选用合适的漏电小的聚苯电容即可实现采样与保持电路。 3 系统硬件电路设计 系统制定出系统总体方案：输入信号经阻抗变换电路后进行程控放大，再经采样与保持电路后进人max118进行采样。其中程控放大倍数和a／d采样速率由垂直灵敏度和水平扫描速度确定，采样时刻由上升沿触发判断和等效采样控制单元决定。采样数据存入双端口ram，显示控制模块读取ram内容并控制dac904输出显示。图1为系统总体设计实现框图。 3．1 程控放大及前级阻抗匹配 信号先经前级ad811的阻抗匹配后实现系统的输入阻抗为1 mω，再经过模拟开关max308cpe来实现不同通道放大的选择，最后经模拟开关com总输出，如图2所示。 3．2 采样与保持电路 基于采样频带要达到10 mhz，系统采用模拟开关ths3166，其特点是低导通电阻、电容，低漏电流，低捕获时间和通断孔径时间，但只工作在正电压范围，故需前级加法器。开关前再加一级射极跟随器，采用带动容
＋5V或＋3V单电源操作；高无寄生动态范围：20MHz输出100MSPS：64dBc；低干扰：3pV，低功耗：在＋5V时170mW；内部基准：可选Ext。基准；可调式全刻度范围；倍乘式选择
请问有人用过dac904吗？急！这个芯片的时钟一般是多少？最低多少？在datasheet上没有啊，请指点愚钝，谢谢！
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