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基于FPGA的双备份多路数据采集存储系统的设计与实现
。 3系统软件设计 3.1采集控制逻辑的设计对于多通道异步时分采集这种形式的电路，由于在电子开关切换的过程中存在着串扰，信号受到该串扰后，滤波放大器的输出在adc采样前未稳定至其应有的精度，就会对adc的采样有影响，从而影响采集精度。所以，为了解决串扰问题，只有在实践的基础上，靠经验去选择合适的运放，或者是通过硬件与系统软件优化相结合的方法寻找解决途径。在确保系统采样率的前提下，本设计通过硬件与软件相结合的方法来解决串扰问题。硬件上采集模块选择sr（压摆率）较高的运放lf247作为滤波跟随器，软件上则以并行的工作方式确保采样前采样通道信号的稳定，即在时序设计上，主程序中采用了两个进程：（1）完成数据的转换、帧计数和数据的传输；（2）根据帧计数frame_cnt控制通道地址信号a和p进行通道切换。这两个进程并行执行。 fpga采集控制逻辑流程图如图4所示。其中，a为通道选择输出，接adg506的通道选择控制端（a3~a0）；p为adg506选通信号，接adg506的片选端（en）。由于存储器采用双备份设计以及对两片存储器的写入操作完全相同，故采集控制