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AD5362 Datasheet

  • AD5362

  • 8-Channel, 16/14-Bit,Serial Input, Voltage-Output DAC

  • 932.00KB

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  • AD

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Preliminary Technical Data
FEATURES
8-channel DAC in 52-LQFP and 56-LFCSP
Guaranteed monotonic to 16/14 bits
Nominal output voltage range of -10 V to +10 V
Multiple output spans available
Temperature Monitoring Function
Channel Monitoring Multiplexer
GPIO Function
System calibration function allowing user-programmable
offset and gain
Channel grouping and addressing features
Data error checking feature
8-Channel, 16/14-Bit,
Serial Input, Voltage-Output DAC
AD5362/AD5363
SPI compatible serial interface
2.5 V to 5.5 V JEDEC-compliant digital levels
Power-on reset
Digital reset (RESET)
Clear function to user-defined SIGGND (CLR pin)
Simultaneous update of DAC outputs (LDAC pin)
APPLICATIONS
Instrumentation
Industrial Control System
PLC Analog I/O Cards
Level setting in automatic test equipment (ATE)
Variable optical attenuators (VOA)
Precision Medical Instruments
FUNCTIONAL BLOCK DIAGRAM
DV
CC
V
DD
V
SS
AGND DNGD
LDAC
TEMP_OUT
PEC
MON_IN0
MON_IN1
TEMP
SENSOR
CONTROL
REGISTER
VOUT0 -
VOUT7
6
MUX
8
AD5362, n = 16
AD5363, n = 14
4
n
n
n
A/B SELECT 4
REGISTER
n
X1 REGISTER
n
M REGISTER
C REGISTER
TO
MUX 2's
n
A/B
MUX
X2A REGISTER
X2B REGISTER
VREF0
14
14
OFS0
REGISTER
n
DAC 0
REGISTER
OFFSET
DAC 0
BUFFER
MUX n
2
DAC 0
OUTPUT BUFFER
AND POWER
DOWN CONTROL
BUFFER
GROUP 0
VOUT0
n
MON_OUT
2
GPIO
BIN/2SCOMP
SYNC
SDI
SCLK
SDO
BUSY
SERIAL
INTERFACE
GPIO
REGISTER
路
路
路
路
路
路
n
n
n
n
n
路
路
路
路
路
路
n
路
路
路
路
路
路
n
路
路
路
路
路
路
A/B
MUX
路
路
路
路
路
路
X1 REGISTER
M REGISTER
C REGISTER
X2A REGISTER
X2B REGISTER
MUX n
2
路
路
路
路
路
路
n
DAC 3
REGISTER
路
路
路
路
路
路
路
路
路
路
路
路
DAC 3
路
路
路
路
路
路
OUTPUT BUFFER
AND POWER
DOWN CONTROL
VOUT1
VOUT2
VOUT3
SIGGND0
GROUP 1
14
OFS1
REGISTER
14
OFFSET
DAC 1
BUFFER
X2A REGISTER
X2B REGISTER
MUX n
2
n
DAC 0
REGISTER
DAC 0
OUTPUT BUFFER
AND POWER
DOWN CONTROL
VREF1
4
RESET
CLR
STATE
MACHINE
n
n
n
n
A/B SELECT 4
REGISTER
n
X1 REGISTER
n
M REGISTER
C REGISTER
TO
MUX 2's
n
A/B
MUX
n
VOUT4
路
路
路
路
路
路
POWER-ON
RESET
n
n
n
n
路
路
路
路
路
路
n
路
路
路
路
路
路
n
路
路
路
路
路
路
A/B
MUX
路
路
路
路
路
路
路
路
路
路
路
路
MUX
2
X1 REGISTER
M REGISTER
C REGISTER
X2A REGISTER
X2B REGISTER
n
n
DAC 3
REGISTER
路
路
路
路
路
路
路
路
路
路
路
路
DAC 3
路
路
路
路
路
路
OUTPUT BUFFER
AND POWER
DOWN CONTROL
VOUT5
VOUT6
VOUT7
SIGGND1
AD5362/
AD5363
n
5362-0001B
Figure 1.
AD5362/AD5363鈥擯rotected by U.S. Patent No. 5,969,657; other patents pending
Rev. PrF
Information furnished by Analog Devices is believed to be accurate and reliable.
However, no responsibility is assumed by Analog Devices for its use, nor for any
infringements of patents or other rights of third parties that may result from its use.
Specifications subject to change without notice. No license is granted by implication
or otherwise under any patent or patent rights of Analog Devices. Trademarks and
registered trademarks are the property of their respective companies.
One Technology Way, P.O. Box 9106, Norwood, MA 02062-9106, U.S.A.
www.analog.com
Tel: 781.329.4700
Fax: 781.326.8703
漏 2006 Analog Devices, Inc. All rights reserved.

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