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CY7C1464AV33-167BGI Datasheet

  • CY7C1464AV33-167BGI

  • 36-Mbit (1M x 36/2M x 18/512K x 72) Pipelined SRAM with NoBL...

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CY7C1460AV33
CY7C1462AV33
CY7C1464AV33
Switching Waveforms
Read/Write/Timing
[24, 25, 26]
1
CLK
t
CENS
t
CENH
t
CH
t
CL
2
t CYC
3
4
5
6
7
8
9
10
CEN
t
CES
t
CEH
CE
ADV/LD
WE
BW
x
ADDRESS
t
AS
A1
t
AH
A2
t
DS
t
DH
A3
A4
t
CO
t
CLZ
t
DOH
A5
t
OEV
A6
t
CHZ
A7
Data
In-Out (DQ)
D(A1)
D(A2)
D(A2+1)
Q(A3)
Q(A4)
t
OEHZ
Q(A4+1)
D(A5)
Q(A6)
t
DOH
OE
WRITE
D(A1)
WRITE
D(A2)
BURST
WRITE
D(A2+1)
READ
Q(A3)
READ
Q(A4)
BURST
READ
Q(A4+1)
WRITE
D(A5)
t
OELZ
READ
Q(A6)
WRITE
D(A7)
DESELECT
DON鈥橳 CARE
UNDEFINED
Notes:
24. For this waveform ZZ is tied low.
25. When CE is LOW, CE
1
is LOW, CE
2
is HIGH and CE
3
is LOW. When CE is HIGH,CE
1
is HIGH or CE
2
is LOW or CE
3
is HIGH.
26. Order of the Burst sequence is determined by the status of the MODE (0 = Linear, 1 = Interleaved).Burst operations are optional.
Document #: 38-05353 Rev. *D
Page 20 of 27
[+] Feedback

CY7C1464AV33-167BGI 产品属性

  • 84

  • 集成电路 (IC)

  • 存储器

  • -

  • RAM

  • SRAM - 同步

  • 36M（512K x 72）

  • 167MHz

  • 并联

  • 3.135 V ~ 3.6 V

  • -40°C ~ 85°C

  • 209-BGA

  • 209-FBGA（14x22）

  • 托盘

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