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IDT79RC32T355-150DH Datasheet

  • IDT79RC32T355-150DH

  • IDT Interprise Integrated Communications Processor

  • 991.93KB

  • 47页

  • IDT

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IDT 79RC32355
Clock Parameters
(Ta = 0掳C to +70掳C Commercial, Ta = -40掳C to +85掳C Industrial, Vcc I/O = +3.3V卤5%,V
cc
Core and V
cc
P = +2.5V卤5%)
133MHz
Min
100
25
15
6
6
鈥?/div>
鈥?/div>
鈥?/div>
Max
133
67
40
鈥?/div>
鈥?/div>
3
3
卤250
150MHz
Min
100
25
13.3
5.4
5.4
鈥?/div>
鈥?/div>
鈥?/div>
Max
150
75
40
鈥?/div>
鈥?/div>
2.5
2.5
卤200
180MHz
Min
100
25
11.1
5.4
5.4
鈥?/div>
鈥?/div>
鈥?/div>
Max
180
90
40
鈥?/div>
鈥?/div>
2.5
2.5
卤200
Timing
Diagram
Reference
Figure 4
Parameter
Internal CPU pipeline clock
1
CLKP
2,3,4
Symbol
Frequency
Frequency
Tperiod1
Thigh1
Tlow1
Trise1
Tfall1
Tjitter
Reference
Edge
none
none
Units
MHz
MHz
ns
ns
ns
ns
ns
ps
1
The CPU pipeline clock speed is selected during cold reset by the boot configuration vector (see Table 2).
3
USB clock (USBCLKP) frequency must be less than CLKP frequency.
4
ATM Utopia clock (RXCLKP and TXCLKP) frequency must
2
Ethernet clock (MIIRXCLKP and MIITXCLKP) frequency must be equal to or less than 1/2 CLKP frequency.
be equal to or less than 1/2 CLKP frequency.
Table 3 Clock Parameters
Tlow1
Tperiod1
CLKP
Tjitter
Tjitter
Trise1
Tfall1
Thigh1
Figure 4 Clock Parameters Waveform
15 of 47
May 25, 2004

IDT79RC32T355-150DH 产品属性

  • 24

  • 集成电路 (IC)

  • 嵌入式 - 微处理器

  • Interprise™

  • RISC 32-位

  • -

  • 150MHz

  • 2.5V

  • 表面贴装

  • 208-BFQFP

  • 208-PQFP（28x28）

  • 托盘

  • 79RC32T355-150DH

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