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GS70328SJ-12IT Datasheet

  • GS70328SJ-12IT

  • 32K x 8 256Kb Asynchronous SRAM

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GS70328SJ/TS
Write Cycle 1: WE control
t
WC
Address
t
AW
OE
t
CW
CE
t
AS
WE
t
DW
Data In
t
WHZ
Data Out
H
IGH IMPEDANCE
D
ATA VALID
t
WR
t
WP
t
DH
t
WLZ
Write Cycle 2: CE control
t
WC
Address
t
AW
OE
t
AS
CE
t
B
W
UB, LB
t
WP
WE
t
DW
Data In
Data Out
D
ATA VALID
t
WR1
t
CW
t
DH
H
IGH IMPEDANCE
Rev: 1.11 11/2004
7/11
漏 1999, GSI Technology
Specifications cited are subject to change without notice. For latest documentation see http://www.gsitechnology.com.

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