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言 现要研制一台检测设备，采用工控机结构。需要设计一个将上位机与dsp、dds等功能单元（做成扩展卡插在扩展槽中）连接起来的模块单元（即用来传输控制命令、状态和信号数据的接口部件）。在设计计算机扩展接口之前，首先考虑的是采用哪种总线形式。pci总线是intel公司推出的一种高性能局部总线，它的主要特点是：①具有地址数据多路复用的高性能32位或64位的同步总线。总线引脚数目和部件数量少（对于总线目标设备只有47根信号线，对于主设备最多只有49根信号线），降低了成本及布线复杂度。②pci局部总线在33mhz总线时钟、32位数据通路时，可达到峰值132mbit/s的带宽；在33mhz总线时钟，64位数据通路时可达到峰值264mbit/s的带宽；在66mhz主频时，对于32位数据通路和64位数据通路带宽的峰值，可分别达到264mbit/s或528mbit/s的带宽；pci总线还有线性突发传输功能，保证了满载的高速传输。③pci总线的设计是独立于处理器的，可以方便地符合pci规范的微机和工作站系统中进行硬件移植，目前已成为嵌入式系统的局部总线之一。④隐蔽的总线仲裁，减小了仲裁开销。⑤极小的存取延时，采用
00设计一个基本的高速摄像机接口电路。在本例中，使用了飞思卡尔mcm20014 cmos传感器，但其他传感器可以使用几乎完全相同的接口机制。该接口非常明了，而且只需较少的接口逻辑就能完成连接。 使用mpc5200的时钟假设 ---最可能的xlb释放目标频率为132mhz；ipbus为66mhz；pciclk(外部总线时钟)为66mhz；xtal的预期输入频率为33mhz。对于本应用，最大的pci频率为33mhz。 ---xlb与ipbus、ipbus与pciclk间的时钟比可能为4:1、2:1或1:1。在xlb为132mhz时，ipbus必须设置为4:1或2:1(分别适用于33mhz或66mhz的ipbus)。根据ipbus 的情况(33mhz、16.5mhz与33mhz ipbus一起工作；或33mhz与66mhz ipbus一起工作)，pciclk可能支持1:1的比率，也可能
的支持，为汽车安全系统的剩余部分提供了经济高效的集成，并降低了与这些网络进行通信的延迟。---下面介绍如何通过pci接口，为mpc5200设计一个基本的高速摄像机接口电路。在本例中，使用了飞思卡尔mcm20014 cmos传感器，但其他传感器可以使用几乎完全相同的接口机制。该接口非常明了，而且只需较少的接口逻辑就能完成连接。 使用mpc5200的时钟假设---最可能的xlb释放目标频率为132mhz；ipbus为66mhz；pciclk(外部总线时钟)为66mhz；xtal的预期输入频率为33mhz。对于本应用，最大的pci频率为33mhz。---xlb与ipbus、ipbus与pciclk间的时钟比可能为4:1、2:1或1:1。在xlb为132mhz时，ipbus必须设置为4:1或2:1(分别适用于33mhz或66mhz的ipbus)。根据ipbus 的情况(33mhz、16.5mhz与33mhz ipbus一起工作；或33mhz与66mhz ipbus一起工作)，pciclk可能支持1:1的比率，也可能支持2:1的比率。在处理器端，可能使用一个66mhz的pciclk ，但市场上的图像
当你需要测量高速时钟频率时，可能选择价位昂贵的台面仪器。而实际上，使用低价位数字测试仪器的数字捕获能力，再加上一些dsp软件函数即可测试高速时钟。下文介绍了具体的实现办法。 奈奎斯特定律的混叠 我们都相信，取样原理称，取样频率必须比被测最高频率高两倍。例如，当捕获160mhz的时钟，就要用320mhz以上的频率。如果使用33.333mhz取样器捕捉160mhz时钟，例如nextest marerick公司的数字捕捉仪，则时钟信号必然会出现混叠，或者可能得到另一个较低的频率。 一个160mhz时钟会混叠成为6.666mhz，因为160mhz正好比33.333mhz*5=166.666mhz低6.666mhz。用33.3333333mhz的取样率对160mhz取样时，在频域产生的不同频段如图1a所示。图中最右边是133mhz频段（4*33mhz）至166mhz频段（5*33mhz）。类似dci那样的仪器不允许你真正测得该频段的信号，但是这些信号时的确存在的，并且证明这是落入到奈奎斯特频率段的混叠频率。图中黄色表示的是从dc至16.666mhz。 点击看原图图1对160mhz信号取样，a)
摘 要： 介绍一种使用pci宏核逻辑进行的更加简单高效的pci口设计方法。该方法将pci接口和pci用户逻辑集成在一片fpga里，可以对整个逻辑进行仿真调试，大大缩短了开发周期、提高了系统集成度和性能。重点叙述了altera公司提供的32位taget接口宏核pci_t32的原理和结构，分析了时序设计要点，给出了典型应用的逻辑设计框图和注意事项。关键词：pci总线 接口 现场可编程逻辑阵列 仿真 1 pci总线及其接口概述pci总线是高速同步总线，具有32bit总线宽度，工作频率是33mhz，最大传输率为132mbyte/s，远远大于isa总线5mbyte/s的速率。picmg(pci工业计算机制造商联盟)制定的更加坚固耐用的compact pci总线规范，支持64位总线宽度，66mhz作频率，最大传输率为528mbye/s。基于pc机的高速数据采集系统和各种虚拟仪器，几乎都选择了pci总线。在现代高速通讯、测试等领域的嵌入式应用中，compact pci总线大有超过vme和vxi总线的趋势。pci的高性能、高效率以及与现有标准的兼容性和充裕的发展潜力，是其它总线所不能及的，被计算
带通滤波器是使那些高于低端截止频率，低于高端截止频率的所有频率通过。图中的电路设计波段从ZMHz到33MHz，所以覆盖了整个HF短波波段而消除了来自LF和MWAM波段广播台以及VHF电视台的干扰。注意每个部分都在各自的屏蔽...
图中的滤波器虽不如上面那个那么美观但同样有效。这种方法就是把低通部分和高通部分串连起来。图的输入端那边是上一节中适用的AM-BCB滤波器，而输出端那边则是同样设计的一个33MHz低通滤波器。
言 现要研制一台检测设备，采用工控机结构。需要设计一个将上位机与dsp、dds等功能单元（做成扩展卡插在扩展槽中）连接起来的模块单元（即用来传输控制命令、状态和信号数据的接口部件）。在设计计算机扩展接口之前，首先考虑的是采用哪种总线形式。pci总线是intel公司推出的一种高性能局部总线，它的主要特点是：①具有地址数据多路复用的高性能32位或64位的同步总线。总线引脚数目和部件数量少（对于总线目标设备只有47根信号线，对于主设备最多只有49根信号线），降低了成本及布线复杂度。②pci局部总线在33mhz总线时钟、32位数据通路时，可达到峰值132mbit/s的带宽；在33mhz总线时钟，64位数据通路时可达到峰值264mbit/s的带宽；在66mhz主频时，对于32位数据通路和64位数据通路带宽的峰值，可分别达到264mbit/s或528mbit/s的带宽；pci总线还有线性突发传输功能，保证了满载的高速传输。③pci总线的设计是独立于处理器的，可以方便地符合pci规范的微机和工作站系统中进行硬件移植，目前已成为嵌入式系统的局部总线之一。④隐蔽的总线仲裁，减小了仲裁开销。⑤极小的存取延时，采用
actpci总线核心技术 为了满足日益提高的处理器速度对海量数据的快速传输和快速处理的要求，1992年，intel公司定义了pci总线作为局部总线，直接用于互连cpu与周边器件，如与显示控制器、网络控制器、内存控制器等互连。为了研制和管理pci标准，成立了pci总线特别兴趣组织（pcisig），并先后推出了pci local bus specification rev. 2.1、rev. 2.2以及最新版本rev. 2.3，pci总线也由芯片级互连总线发展成了板级互连总线。pci总线的32位/33mhz标准具有132mb/second数据传输速度，其64位/66mhz的标准可以达到528mb/second，所以，相对isa或vme总线每秒几mb或几十mb的传输速度而言，pci是高速总线。为了将pci总线应用于嵌入式领域，1994年成立了pci工业计算机制造商协会（picmg），主要动机就是为嵌入式计算机（如工业计算机，医疗设备，通信设备，交通设备以及军事系统等）研制通用技术标准。现在picmg在全球有三个分会，分别为picmg china（即picmg/prc）、 picmg europe和
路需要更换的时候，维护都非常简单。 关于升级 由于pxi系统的模块化，升级单个组件很容易。比方说，某用户希望升级到更快的处理器，则可以拆下控制器进行更换。因为所有的设备都支持标准软件，所以只要在新的控制器里装上软件和驱动程序，然后插回机箱内就可以了。这些变化对使用者来说几乎是透明的。 然而，对于工业计算机的配置，用户通常需要为了升级处理器而拆除计算机里所有的板卡，然后更换整个计算机或主板。这样的升级过程将耗费不少时间和代价，而且很复杂。 i／o扩展 pxi系统的设计具有很好的可扩展性。在每个33mhz总线区段上，pxi背板可以集成7个模块 (见图1)，而工业计算机只能有4个。 通过pci-pci桥，一个pxi机箱内可以容纳更多板卡。使用mxi-3接口，用户更可以轻易地扩展多个机箱。理论上，基于33mhz总线区段的pxi系统插槽上限是256个。 总线式触发线 在用到触发时，pxi的触发信号可以从背板上通过，用户不必像在计算机上那样将板卡用电缆连接起来。pxi背板上有8根专用的触发线，与包括系统控制器槽在内的每个槽相连。有了这些特性，用户可以实现更加复杂的模块触发，例如用一个模块触发另一个模块，
美国国家半导体这款型号为lmp8100a的可编程增益放大器利用软件调节增益，增益则由1v/v至16v/v，共分为16个步级，以1v/v作为一步级增减，而且在摄氏-40度至 125度的工业温度范围内操作，增益准确度保证可达0.03%。此外，美国国家半导体也推出型号为lmp8100的半高精度级别可编程增益放大器，其特点是只要在摄氏-40度至 85度的温度范围内操作，增益准确度保证可达0.075%。这两款放大器的闭环增益可以通过一列共16个高精度薄膜电阻加以设定。这两款可编程增益放大器的核心，都具有33mhz cmos 输入、轨到轨输入/输出（rrio）运算放大器、典型的110db开环增益等特征。 许多测量仪表产品对输入与输出的比例都有严格的规定，例如传感器的输出必须反映模拟/数字转换器的满标度输入，以确保对输入信号作出最灵敏的响应。美国国家半导体的lmp8100a增益放大器结合1msps的12位单通道模拟/数字转换器如adc121s021、adc121s051或adc121s101，是适用于测量仪表产品的最佳模拟信号路径解决方案之一。 lmp8100
1格式ntsc图像编码或者每秒6.25帧的16路d1格式pal图像编码。能够接收未经压缩的itu-r.bt-656视频和i2s音频信号。其中，视频信号将被压缩成mepg-1, 2, 4格式，而音频信号则可被转成mpeg-layer 1, 2、mp3、aac、ac-3、g.711、g.726、g.729等各种格式。在系统层，vw5010将音频与视频信号结合在一起形成一个传输流和程序流。编码器的输入接口包括：四个8位的 itu-r.bt-656口(视频)、四个i2s口(主机或从机模式)。输出则为一个33mhz的32位pci接口。vw5010编码端还提供8位元osd的支持，以方便厂商轻松实现识别通道号码、时间、地点或密码遮盖功能。 来看解码方面。这款单芯片的四路d1编***不仅能够接收mpeg-1, 2, 4或者h.263格式的视频比特流输入，将其转成itur.bt-656视频格式。也可将mpeg-1 layer 1, layer 2、mp3、aac、ac-3、g.711、g.726或者g.729的音频比特流输入解压缩后从is2接口输出。与编码器相反，设计人员为其***配备了四个8位 itu-
带通滤波器是使那些高于低端截止频率，低于高端截止频率的所有频率通过。图中的电路设计波段从zmhz到33mhz，所以覆盖了整个hf短波波段而消除了来自lf和mwam波段广播台以及vhf电视台的干扰。注意每个部分都在各自的屏蔽罩内。这对于任何多节滤波器都是一个很好的设计，它阻止了元件（尤其是线圈）之间的相互影响。 图 一个2～33mhz带通滤波器电路图 来源:lover
图中的滤波器虽不如上面那个那么美观但同样有效。这种方法就是把低通部分和高通部分串连起来。图的输入端那边是上一节中适用的am-bcb滤波器，而输出端那边则是同样设计的一个33mhz低通滤波器。 图 一个由低通和高通滤波器串联而成的2～33mhz的带通滤波器电路图 来源:lover
电路说明：通过使用一个27.5到33mhz的晶体，82.5到99mhz的范围内将会发生第三次谐波。 来源:zhengyuan
sb-100是一种普及型遥控组件，遥控发射组件的型号为sb-100atx，接收组件的型号为 sb-100arx。sb-100atx组件是一种由saw元件组成的高稳定度无线电遥控发射电路，它的电路组成与cs900基本相同。电路内包括由超高频三极管c3356与saw元件组成的载频振荡发射电路和以数字编码电路pt2262组成的发射编码电路，如图所示。sb-100atx发射组件具有频率稳定度高、发射功率大、适应能力强的特点，发射频率在25*33mhz范围内选择。该电路采用小型贴片式元件，外形尺寸为65×38×15(mm)，工作电压12v，采用四路数字编码，设有四个发射按键。 遥控发射组件sb-100atx电路 来源:pwreyt
最新龙梦电脑主板写真:龙芯2e cpu清晰可见tom科技讯 10月8日，tom科技从龙梦科技处获得最新龙梦电脑主板写真。照片如下：龙梦电脑主板上，龙芯2e cpu清晰可见龙梦电脑参数处理器龙芯2e cpu，主频600mhz-900mhz，支持ddr333内存总线，北桥简单北桥用ict nb2e (altera ep2c20f484)芯片，功耗0.1-0.3瓦内存插槽200线 pc2700-sodimm槽一个,标配256mb内存，可扩展到512mb南桥威盛vt82c686b，33mhz 32-bit pci接口显示ati radeon 7000-m，33mhz 32-bit pci接口，内部集成16mb ddr内存，外接vga显示输出和s-video输出网络realtek 8139d, 33mhz 32-bit pci接口，外接rj45接口usbnec upd720101gj 33mhz 32-bit pci接口，外接4个usb2.0口,两个一组上下叠放声音由南桥引出ac’97输出接口ide接口一个ide接口，一个mini-ide接口，mini-ide接2.5英寸笔记本硬盘并能叠放且固定在主板上，
33mhz.html">33mhz震荡电路(有图)问题请教我的一个项目用到如图的33mhz.html">33mhz震荡器.但不知为什么开机时震荡频率老是只有10.8mhz,如果换晶体,则可能变了频率,但不时想要的33mhz.但如果用起子碰一下输入端13脚,那么震荡频率就变了正常的33mhz.html">33mhz了.这是什么原因?请各位大虾指教.不胜感激! * - 本贴最后修改时间：2005-4-7 8:41:35 修改者：emi3721
要425的开发板可以找我要425的评估板可以找我intel.html">intel ixp425 xscale网络开发评估板：增强版！ 硬件资源配置： ◆处理器：intel.html">intel ixp425bd，bga，533mhz.html">33mhz xscale内核，内部集成3个高性能npe(网络处理器引擎) ◆64mb 32位pc133 sdram内存(可扩展成256m) ◆16mb 16位intel nor flash ◆32mb nand flash（可扩展到2gb） ◆usb 2.0全速(12mbps)：板载2个usb host 2.0全速接口 ＋ 1个usb device接口 ◆usb 2.0高速(480mbps)：usb 2.0高速接口卡，同时支持4个usb host高速接口（选配模块） ◆ide：ata 133 raid ide接口卡，1块ide卡可同时支持2个ide接口硬盘（选配模块） ◆千兆网口：性能超强的10/100/1000m自适应千兆网卡（选配模块） ◆pci总线：32bit，33mhz.html">33mhz~66mhz，3个标准pci接口和1个minpci
plx 现在推出了 pci 9030 smartarget i/o 加速器。smartarget technology性能特性符合 pci v2.2 规范的 32 位 33mhz 目标接口芯片，使 pci 突发传输速度高达 132 兆字节/秒。 高达 60mhz 的局域总线操作使突发传输速度高达 240 兆字节/秒 pci 目标预读取模式 pci 目标可编程突发模式 pci 目标写延迟 上传存储器写入 灵活特性可编程 32 位局域总线操作，高达 60mhz 支持 5 个 pci 到局域地址空间 九个可编程 gpio 四个可编程芯片选择 支持 compactpci 热交换 big/little endian 编码转换 中断生成器 pci 1.1 版电源管理 3.3v，5v 容错 pci 信号传输 180 针 mbga 或 176 针 pqfp 中的 3.3v cmos 设备 jtag smartarget™ i/o 加速器随着 pci 在当前复杂系统中不断地演化，plx 亦不断地向市场提供领先的高性能 32 位 pci 解决方案。基于这一良好传统，plx 现在推出了 pci 9
总线超过33mhz布线就有得给你玩的了,不是一般人能玩好的.你真的要超过33mhz的总线吗?请三思而后行,搞不好搞出毛病来.
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