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通用工业视频图像叠加的设计与实现
稳定、可靠运行。为减少时延，扩展电路全部采用高速cmos芯片实现。在此功能较完善的硬件基础上，软件设计简单多了，主要完成系统初始化的按键响应。２硬件设计下面分别详细介绍各个主要部分的电路。 2.1 同步信号的提取及行／场计数器电路准确提取视频信号中的同步信号对于本项目的成攻至关重要，幸运的是市场上提供了lm1881芯片，它仅需几个外接元件，就可以可靠地提取出视频信号中的同步信号。lm1881的引脚及连接电路如图４所示，图中的电容值均为0.1μｆ，电阻阻值为680kω。行／场计数器由193芯片级联而成。按pal制式规定，场扫描频率为50hz，帧频25hz，总扫描线数625，由于分为奇偶场扫描，每场有312行，需用二进制地址9位。选择4mhz的晶振行为行计数器的计数脉冲输入，那么每行有256个像素点，计算公式为：每片193有四位输入、输出端，输入端均接“0”，输出端组成地址总线。为保持行、场计数器电路的整齐，并保留一定的扩充性，行、场计数器各设3片193芯片实现。行同步信号经过一级非门，送往行计数器三片193的清零端mr；同时作为场计数器的计
一种几乎不耗电的无线遥控门铃设计
可选择容量更大的，对应门铃持续发出的音乐时间可以更长。dc/dc变换器选用bl8530,输出电压为3v,这是一种开关型升压稳压芯片，效率可达85%,最低输入电压只要0.8v,最大输出电流达200ma,静态电流小于5.5μa.微功耗遥控接收模块选用同厂家配套的j04v,工作电压2.6~3.5v,工作电流0.15~0.3 ma,有6个引脚，①脚接天线，②、③脚数据输出，④脚测试，⑤脚接地，⑥脚接电源正极。遥控距离可达100m. 解码集成电路采用微功耗的hx2272,有18个引脚，振荡电阻r3为680kω。音乐集成块为tr95.三极管选用9011.降压电容为33nf即0.033μf,耐压400v以上。限流电阻r2为100ω，泄放电阻r1为22mω，4个整流二极管为1n4007,稳压二极管5v,发光二极管选用小型普通的，电感为47μh,d5为1n5819,电容c3为220μ16v电解，抗干扰电容c5、c6为0.01μf瓷片。三、电路特点 1、门铃接收部分几乎不耗电，经测算，大约9年才耗1度电。 2、使用寿命特长，彻底解决电阻、稳压管发热等问题。 3、所采用的超级电容充放
电感器的识别与检测
两表笔接触电感的两端，表针应指示导通，否则说明断路。该法适合粗略、快速测量电感是否烧坏。 2．贴片电感器贴片电感器可分为小功率电感器及大功率电感器两类。小功率电感器主要用于主板电路等；大功率电感器主要用于逆变器的储能器件或la滤波器件。（1）贴片电感的标注方法小功率电感的代码有nh及；μh两种单位。用nh做单位时，用n或r表示小数点。例如，4n7表示4.7nh，4r7则表示4.7ph；10n表示10nh，而 10ph则用100来表示。大功率电感上有时印有680k、220k字样，分别表示68ph和22 ph。（2）小功率贴片电感器小功率贴片电感器有三种结构：绕线贴片电感器、多层贴片电感器、高频贴片电感器。 ①绕线贴片电感器绕线贴片电感器是用漆包线绕在骨架上做成的，根据不同的骨架材料、不同的匝数而有不同的电感量及0值。它有三种外形，如图1所示。图1 绕线贴片电感器的外形 a型是内部有骨架绕线，外部有磁性材料屏蔽，经塑料模压封装的结构；b型是用长方形骨架绕线而成（骨架有陶瓷骨架或铁氧体骨架），两端头供焊接
一种无线射频收发模块的应用
弱而干扰点又引起信号不稳时，可将天线剪去5cm也许会有所改善。也可采用螺旋天线或将天线直接做在pcb板上，甚至无天线接收，当然接收灵敏度要下降。匹配良好的收发天线能使收发模块性能达到最佳状态，而匹配不良的收发天线会使收发距离变得很近。 j05c最大数据传输速度为5kbps，调整内部电容值可达到20kbps，但过高的数据速率会降低接收灵敏度及增大误码率。如用于一般遥控报警器，不必使用过高的速率，现在遥控报警器普遍使用性价比较好的pt2262编解码及pt2272解码器，振荡电阻分别采用3.3mω和680kω即可有较好的收发距离（此电阻值必须精确）。如用于单片机收发系统，速率可取4.8kbps或2.4kbps，同时应兼顾到收射效率。当数据中有连续几个“1”且脉宽超过1ms时，会引起发射效率下降，而且太大的占空比及大低的频率易引起过调制。高电平脉宽在0.1～1ms范围内，收发效果较好。不合适的数据速率同样会影响到收发距离，甚至收不到信号。 j05c输出端可直接与标准解码器及单片机接收。j05c在未收到发射信号时可输出随机噪声，幅度为vdd-0.3v值；当收到信号时，噪声被抑制；当信号变弱时，出现噪
FPGA开始进入40纳米时代
2008年5月20号，altera公司发布了业界首款40-nm fpga和hardcopy® asic。stratix® iv fpga和hardcopy iv asic都提供收发器，在密度、性能和低功耗上遥遥领先。stratix iv系列有680k逻辑单元(le)，比altera的stratix iii系列高2倍，是目前市场上密度最大的fpga。hardcopy iv asic系列在密度上和stratix iv器件等价，具有1330万逻辑门。altera® 40-nm器件满足了众多市场对各种高端应用的需求，例如，无线和有线通信、军事、广播和asic原型开发等。随着对互联网传输视频、高速无线数据和数字电视等服务需求的不断增长，设计人员需要能够提供更高的数据速率、更高的接口带宽和数据处理能力更强的解决方案，而且其功效要好。为解决这些设计挑战，altera借助在收发器、存储器接口、低功耗技术和fpga内核体系结构上的创新，实现40-nm器件的新功能。 stratix iv fpga系列采用了tsmc的40-nm工艺制造，包括两个型号，增强型具有丰富的存储器

NTC 片式热敏电阻器
5 0.25±0.1 1608 1.6±0.15 0.8±0.15 0.8±0.15 0.3±0.2 2012 2.0±0.20 1.25± 0.20 0.85±0.20 0.5± 0.3 主要性能指标型号 25℃时阻值 b值(25℃~50℃) 时间常数(s) 耗散系数(mw/℃) 额定功率(mw) xzcn1005 47ω~680kω 2700~4300 <3 1.0 100 xzcn1608 30ω~680kω 2700~4500 <3 1.0 100 xzcn2012 10ω~1mω 2700~4600 <3 2.0 200工作温度：-40℃~+125℃
Altera开始发售业界首款40-nm Stratix IV FPGA芯片EP4SGX230
广播、测试、医疗和军事等各类市场的客户， stratix iv fpga 在高端fpga解决方案中具有业界最高的密度、最好的性能、最大的系统带宽以及最低的功耗。此次推出的第一款器件是 ep4sgx230 ，它含有230k逻辑单元(le)，工作速率高达8.5 gbps的36个嵌入式收发器，17 mbits ram以及1,288个嵌入式乘法器。采用了40-nm工艺节点技术， stratix iv fpga 系列包括两种型号产品，增强型(e)和收发器型(gx)。stratix iv系列提供多达680k逻辑单元，逻辑容量是竞争高端fpga的两倍以上，性能比竞争解决方案高出35％。器件还支持速率高达1067 mbps的ddr3存储器接口。stratix iv gx fpga具有工作在8.5 gbps的48个收发器，支持开发新一代宽带通信基础设施。 lecroy的psg市场副总裁jim roth评论说：“lecroy选择速率最高、逻辑门数量最多的fpga器件来帮助我们的客户实现丰富的产品功能。stratix iv gx器件的高速收发器和存储器接口，结合其大量的逻辑门和i/o，使lecroy能
Altera发售40nm FPGA EP4SGX230
片。面向通信、广播、测试、医疗和军事等各类市场的客户，stratix iv fpga在高端fpga解决方案中具有业界最高的密度、最好的性能、最大的系统带宽以及最低的功耗。此次推出的第一款器件是ep4sgx230，它含有230k逻辑单元(le)，工作速率高达8.5 gbps的36个嵌入式收发器，17 mbits ram以及1,288个嵌入式乘法器。采用了40nm工艺节点技术，stratix iv fpga系列包括两种型号产品，增强型(e)和收发器型(gx)。stratix iv系列提供多达680k逻辑单元，逻辑容量是竞争高端fpga的两倍以上，性能比竞争解决方案高出35％。器件还支持速率高达1067 mbps的ddr3存储器接口。stratix iv gx fpga具有工作在8.5 gbps的48个收发器，支持开发新一代宽带通信基础设施。具有业界最高级的逻辑和连线体系结构，以及altera创新的可编程功耗技术，stratix iv系列是业界功耗最低的高端fpga。根据设计需求，可编程功耗技术针对每一个可编程逻辑阵列模块(lab)、数字信号处理(dsp)模块和存储器模块而采用高速或
FPGA：40纳米器件满足高端应用需求
为帮助设计人员提高产品集成度，进一步创新，altera公司推出了业界首款40nmfpga和hardcopyвasic：stratixвivfpga和hardcopyivasic。以上器件都提供收发器，在密度、性能和低功耗上遥遥领先。stratixiv系列有680k逻辑单元(le)，是目前市场上密度最大的fpga，其密度是alterastratixiii系列密度的两倍。hardcopyivasic系列在密度上和stratixiv器件等价，具有1330万逻辑门。altera40nm器件满足了众多市场对各种高端应用的需求，例如，无线和有线通信、军事、广播和asic原型开发等。随着对互联网传输视频、高速无线数据和数字电视等服务需求的不断增长，设计人员需要能够提供更高的数据速率、更高的接口带宽和数据处理能力更强的解决方案，而且其功效要好。为解决这些设计挑战，altera借助在收发器、存储器接口、低功耗技术和fpga内核体系结构上的创新，实现40nm器件的新功能。 stratixivfpga系列采用了tsmc（台积电）的40nm工艺制造，包括stratixive和stratixivg
Altera发布首款40nm FPGA和HardCopy ASIC
为帮助设计人员提高集成度，进一步创新，altera公司发布了首款40nm fpga和hardcopy asic。stratix iv fpga和hardcopy iv asic都提供收发器，在密度、性能和低功耗上遥遥领先。stratix iv系列有680k逻辑单元(le)，比altera的stratix iii系列高2倍。hardcopy iv asic系列在密度上和stratix iv器件等价，具有1330万逻辑门。altera 40nm器件满足了众多市场对各种高端应用的需求，例如，无线和有线通信、军事、广播和asic原型开发等。随着对互联网传输视频、高速无线数据和数字电视等服务需求的不断增长，设计人员需要能够提供更高的数据速率、更高的接口带宽和数据处理能力更强的解决方案，而且其功效要好。为解决这些设计挑战，altera借助在收发器、存储器接口、低功耗技术和fpga内核体系结构上的创新，实现40-nm器件的新功能。 stratix iv fpga系列采用了tsmc的40-nm工艺制造，包括两个型号，增强型具有丰富的存储器和数字信号处理(dsp)资源(stratix iv e

LM1881作同步分离，只有行同步，没有场同步，为什么？
problem resolved呵呵，原来是把lm1881的第六脚的rset中的电阻值加错了，标称值为680k，但我一不小心整了个22k的，大意啊！！！改过来之后一切正常。谢谢各位兄弟指教！！！
请教监视器十字丝的抖动问题
我的原因我的是因为1881的第5脚(第6脚，记不太清了)要接一个电阻680k和一个电容0.1，是因为我接错成100k了，
关于电流变送电路的疑问
为什么不直接用一个700k左右的电阻常见标准电阻值没有700kω的，只有680kω或750kω。
LPC2xxx ARM的I/O速度实际测试结果,附程序...
刚刚闲着没事, 用arm_lpc2136 和 avr_mega128 比较了一下cpu-2136, 使用如下程序: ads编译.while(1) 主频44m, i/o 只有 650k hz 的速度.{ ioclr |= led1; //iodir 已经设置为出. ioset |= led1; //(为了提高上升速度,俺又在led1上, 上拉了2k的电阻.)} cpu-mega128 使用如下程序, iar编译. while(1) 主频8m, i/o 就有 680k hz 的速度了. portd ^= 0x01; //pd0 已经设置为出.真是搞不懂,为什么lpc2xxx的速度为何上不去.俺正想用2138来做读写一个大的并口存储东东呢.这叫俺怎么敢用啊? 还是有什么地方没做对啊?如何提高读写速度呢?lpc2xxx arm的i/o为何如此的慢?
MOC3041和单片机的接口（附图）
标错了。不好意思，不是680k，是680欧姆。谢谢stycx的提醒^^

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Altera发售40nm FPGA EP4SGX230

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Altera发布首款40nm FPGA和HardCopy ASIC

LM1881作同步分离，只有行同步，没有场同步，为什么？

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