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74HC597 8-bit shift register with input flip... PHILIPS 74HC597PDF下载
74HC597 8-bit shift register with input flip... PHILIPS [NXP Semiconductors] 74HC597PDF下载
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74HC597DB IC HC/UH SERIES, 8-BIT RIGHT PARALLE... PHILIPS 74HC597DBPDF下载
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嵌入式控制器的输入端口设计分析
输出引脚分列在集成块的两边，这样的排列使制作印刷电路板时的布线比较简单；另一方面，74hc574的输出电容值为15 pf，这个值与74hc244的输出电容值几乎一样，因此在设计中一般选用74hc574，电路连接如图3所示，使用锁存器可以同时取样大量的数据输入端。数据选择器可以降低每条总线的负载电容值，而不能同时取样数据输入端。使用数据锁存器，会增大数据总线的电容负载，这样就必须在取样数据线的数量和采用数据选择器的数量之间找到一个恰当的点。图4给出了一个较好的解决方案。在电路中，移位寄存器74hc597被级联在一起，并且与控制器的总线相连接，这样可以给处理器提供大量的数字输入引脚，同时每条总线上的电容负载值又可以达到最小。 74hc597是移位寄存器，它有8个触发器与输入引脚相连，这些触发器是边沿触发的输入锁存器；同时，74hc597有另外的8个边沿触发的锁存器串联在一起，构成移位寄存器。在图4中，当胶粘逻辑一个上升沿信号给rclk时，数据输入引脚的信号被同时取样，接下来处理器通过胶粘逻辑传送一个信号给srload，使取样得到的数据从输入锁存器移入移位寄存器。在移位寄存器内，处理器通过sr

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锁存器74hc534 3-state d flip-flop 三态d型触发器74hc540 3-state buffer 三态缓冲器74hc541 3-state buffer inverter三态缓冲反向器74hc58 dual and or gate 与或门74hc589 3state 8bit shift 8位移位寄存三态输出74hc594 8bit shift reg 8位移位寄存器74hc595 8bit shift reg 8位移位寄存器出锁存74hc597 8bit shift reg 8位移位寄存器入锁存74hc620 3-state transceiver 反向3态收发器74hc623 3-state transceiver 八路三态收发器74hc640 3-state transceiver 反向3态收发器74hc643 3-state transceiver 八路三态收发器74hc646 non-invert bus transceiver 总线收发器74hc648 invert bus tranciver 反向总线收发器

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