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基于AT89818的10M/100M以太网交换机设计
层收发设备，具有更高的信噪比、较低的功耗，是marvell semiconductor inc.的产品。(3)sram采用w25p243a。它是一种64k× 64大小的piplined的cmos高速静态ram，是winbond electronics 公司产品。图33 系统关键电路的设计 3.1 系统时钟的设计由于两个phy芯片的时钟都为50mhz，而sram和at89818的时钟都有75mhz，已经属于高速数字电路的设计，因此在设计时候要考虑信号的完整性。如图2所示，通过缓存器74lvt244可增加时钟的驱动能力，产生2个同相、延迟极小并且一致的时钟输出给2个phy，可保证信号的完整性。另外在pcb设计时也应该让高速信号走线尽量短，以保证系统信号的完整性设计。 3.2 mcu与eeprom、at89818之间控制的系统设计 mcu与at93c46连接如图3所示。mcu通过edo、edi、esk、ecs可对at93c46进行读写；同时，edo、edi、esk、ecs也分别与at89818的do、di、sk、cs相连接。at89818与mcu通过e2tr交换对eeprom的控

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周工，问个问题。
周工，问个问题。我以前买的是2104开发板，现在用的是2132芯片。所以手里没有2132现成的开发板或原理图。现在的板子是我自己根据你们提供的2132＿2138的说明书画的。现在我的主要问题是连机连不上。硬件接法是/rtck接了一个4k7的下拉电阻，然后与jtag相连，/rst是jtag与芯片合用，/trst是由复位电路经过一片74125产生，然后直接与jtag的相应脚相连，与2104的开发板一样，/trst经过一片74lvt244后进入芯片引脚。其它的tdi，tdo，tms，tck都是通过这片244的缓冲后与芯片相应管脚相连接的。晶振部分的接法与2104开发板一样，一个11.0592mhz的晶振并联一个1meg的反馈电阻，外部调整电容为两个40pf的电容。现在，我用示波器观察到的情况是，x1脚的信号为0.8v左右的直流上叠加了0.2v左右的正弦信号，x2脚的信号为0.8v左右的直流上叠加了约0.5v左右的正弦信号。/rtck在上电后保持在2.0v左右，按复位键并不能将其拉低。而2132＿2138使用手册上有这么一句： reset 为低时，p1.26 的低电平使 p1.31:26 复位后用作一个调试

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