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基于FPGA机载实时视频图形处理系统的设计
有效减小信号的码间串扰。系统的dvi视频输出功能采用ti公司的dvi编码芯片tfp410实现，该芯片满足dvi1.0规范，最高支持1 600×1 200分辨率，支持24位真彩色视频。 2.4 pal视频编解码模块设计为便于pal视频信号的长线传输，系统采用差分信号传输pal视频。由于标准的pal信号为单端信号，因此系统在pal信号接收端采用美国ad公司的差分接收放大器ad8130来实现差分pal信号转换成标准单端pal信号，而在pal信号发送端则采用ad公司的高速差分驱动器ad8131实现单端pal信号转换成差分信号。系统采用ad公司的pal解码芯片adv7184对单端pal视频信号进行解码，该芯片具有12个模拟输入通道，内置4个10位adc,实际解码后视频信号支持itu-r bt.656标准（ycrcb 4:2:2），经色彩空间转换后r、g、b分量均可达到8位分辨率，即pal视频解码后可达24位真彩色。系统采用ad公司的pal编码芯片adv7179来实现pal视频信号的输出，该芯片支持itu-rbt.656标准的标准数字视频输入，与pal解码芯片adv718
LTC2207在ARM与FPGA控制下的采集应用
有一个延迟的编码输入作为数字输出，提供了clkout+和clkout-两信号；需要使用正弦时钟编码信号clkout+/clkout-将数据同步转换到数字系统。数据在clkout+的上升沿或clkout-的下降沿锁存，在clkout+下降沿和clkout-上升沿时更新。 2 硬件电路设计信号采集部分主要完成对模拟信号的调理和a/d转换芯片的采集。a/d转换芯片的输入信号是差分的，而被采集的信号是单端的，这就需要把单端信号转换成差分信号。输入的信号经过max4201缓冲后，由差分驱动器ad8131转换成差分信号，驱动a/d转换芯片ltc2207. 采用lvds转发器max9150转换fpga所给的时钟信号，作为ltc2207的采集控制信号enc.max9150的转换电路如图2所示。图2 max9150的转换电路 ltc2207的模拟差分信号输入前端的调理芯片采用低噪声、低功耗、超高速开环缓冲器max4201和高速差分驱动器ad8131.采集输入信号的前端调理电路如图3所示。图中max4201采用±5 v供电，对地并联的电容给电源滤波，为缓冲器提供无干扰的电源。缓冲后的

AD8131
高速：400MHz，－3dB全功率带宽，2000V/μs转换速率；无需外部元件的固定增益为2；内部共模反馈以改善增益和相位；平衡：在10MHz时－60dB；独立输入置位共模输出电压；低失真：在5MHz，200Ω负载时68dB SFDR；电源电压：＋2.7～±5V

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