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66MHz时钟支持;达到231MB/s带宽;低功率CM0S设计(<610mW);掉电模式(<0.5mW)达到1.848Gbit/s数据吞吐率;窄总线减少电缆的大小和成本;290mV(标准值)摆幅LVDS驱动用于低EMI;PLL要求无需外部元件;低轮廓56引脚TSSOP封装;上升边缘数据选通,兼容TIA/BIA-644 LVDS标准