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基于AD7892SQ和CPLD的数据采集系统
0 引言本系统以ad7892sq和cpld(复杂可编程逻辑器件)为核心设计了一个多路信号采集电路，包括模拟多路复用、集成放大、a/d转换，cpld控制等。采用硬件描述语言verilog hdl编程，通过采用cpld使数据采集的实时性得到提高。 1 硬件设计针对多路信号的采集，本系统采用4/8通道adg508a模拟多路复用器对检测的信号进行选择，cmos高速放大器lf156对选中的信号进行放大，ad7892sq实现信号的a/d转换，cpld完成控制功能。电路如图1所示。 ad7892sq是美国ad公司生产的lc2mos型单电源12位a/d转换器，可并行或串行输出。 ad7892sq a/d转换器具有如下特点：单电源工作(+5 v或+10 v)；内部含有采样保持放大器；具有高速的串行和并行接口。 ad7892sq控制字的功能如下： a)mode：输入控制字，低电平时为串行输出，高电平时为并行输出，本系统为并行输出； b)standby：输入控制字，低电平时为睡眠状态(功耗5 mw)，高电平时正常工作，一般应用时接高电平； c)convst：

LF156
可替代昂贵的和模块FET运算放大器；与MOSFET输入设备相比,耐用的JFET允许无熔断处理；高或低的源阻抗低1/ƒ转折,优良的低噪声应用；在大多数单片放大器上,偏置调整不可降解漂移或共模抑制；新输出电路级允许大电容负载(5000F)的使用,无稳定性的问题；内部补偿和大的差分输入电压能力；对数放大器；光电放大器；采样保持电路共同特性；低输入偏置电流：30pA；低输入失调电流3pA；高输入阻抗：1012Ω；低输入噪声电流：0.01PA/ √HZ 高共模抑制比：100dB；大的DC电压增益：106dB