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高速ADC的低抖动时钟设计
其性能在很大程度上决定了接收机的整体性能。在a/d转换过程中引入的噪声来源较多，主要包括热噪声、adc电源的纹波、参考电平的纹波、采样时钟抖动引起的相位噪声以及量化错误引起的噪声等。除由量化错误引入的噪声不可避免外，可以采取许多措施以减小到达adc前的噪声功率，如采用噪声性能较好的放大器、合理的电路布局、合理设计采样时钟产生电路、合理设计adc的供电以及采用退耦电容等。本文主要讨论采样时钟抖动对adc信噪比性能的影响以及低抖动采样时钟电路的设计。 (a)12位adc理想信噪比 (b)ad9245实测信噪比图1 不同时钟抖动情形下12位adc的信噪比示意图时钟抖动对adc 信噪比的影响采样时钟的抖动是一个短期的、非积累性变量，表示数字信号的实际定时位置与其理想位置的时间偏差。时钟源产生的抖动会使adc的内部电路错误地触发采样时间，结果造成模拟输入信号在幅度上的误采样，从而恶化adc的信噪比。在时钟抖动给定时，可以利用下面的公式计算出adc的最大信噪比：根据公式(2)，图1分别给出了量化位数为12-bit时不同时钟抖动情形下adc
ADI新推12BIT单片模数转换器功耗降低40％
器件。此器件以65 msps转换速率工作时功耗为190 mw，40 msps时功耗为135 mw，20 msps的时功耗为90 mw，从而允许用于便携式12 bit多通道系统并且简化了信号路径。ad9237的扩缩功能可进一步节省功耗，当降低转换器速度时可以降低功耗。ad9237采用3 v单电源供电，并且提供独立数字输出驱动电源以便为2.5 v和3 v逻辑器件供电。引脚兼容性和差分采样保持放大器 ad9237与adi公司的10 bit ad9215，12 bit ad9235和14 bit ad9245 20/40/65 msps adc，以及12 bit ad9236，14 bit ad9245 80 msps adc引脚兼容。这使得应用工程师容易改变分辨率和速度，或者便于为下一代系统升级性能。此外，ad9237拥有专利权的采样保持放大器（sha）输入级允许用户选择各种输入范围和偏移，其中包括单端应用。ad9237适用于在相继通道中切换满度电压的多路复用系统以及以完全高于奈奎斯特（nyquist）速率对单通道输入信号采样应用。还推荐ad9237与几款adi公司业界领先的放大器产品（包括ad8

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