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AD9225价格行情

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AD9225中文资料

  • 12位高速ADC存储电路设计与实现

    1 ad9225的结构 ad9225是adi公司生产的单片、单电源供电、12位精度、25msps高速模数转换器，片内集成高性能的采样保持放大器和参考电压源。ad9225采用带有误差校正逻辑的四级差分流水结构，以保证在25msps采样率下获得精确的12位数据。除了最后一级，每一级都有一个低分辨率的闪速a/d与一个残差放大器（mdac）相连。此放大器用来放大重建dac的输出和下一级闪速a/d的输入差，每一级的最后一位作为冗余位，以校验数字误差，其结构如图1所示。 图1 ad9225结构图 2 ad9225的输入和输出 （1） 时钟输入 ad9225采用单一的时钟信号来控制内部所有的转换，a/d采样是在时钟的上升沿完成。在25msps的转换速率下，采样时钟的占空比应保持在45％~55％之间；随着转换速率的降低，占空比也可以随之降低。在低电平期间，输入sha处于采样状态；高电平期间，输入sha处于保持状态。图2为其时序图。图2中： 图2 ad9225时序图 tch——高电平持续时间，最小值为18 ns； tcl——低电平持续时间，最小值

  • CPLD在高速数据采集系统中的应用

    0系列cpld设计的高速数据采集系统已经应用在电力系统某精确故障定位系统中。1 高速数据采集系统的硬件结构 对于一般的高速数据采集系统而言，除了采用高速的a/d转换器、高速存储器等高速器件之外，还要解决如何高速寻址、如何控制总线逻辑、如何进行高速存储以及如何方便地与pc机交换数据等问题。这些问题都是设计一个高速数据采集系统所要共同面对的问题。兼顾这些共性问题，笔者设计了一套以精确故障定位为目的的高速数据采集系统。 该系统的硬件框图如图1所示。在没有故障发生的时候，输入的模拟量通过高速ad芯片ad9225(其转换速率可达到25msps，分辨率为12位)转换成数字量，然后通过cpld构成的数据总线控制器，以高4位和低8位的形式分别存储在两片横向并联的缓冲ram 628512(存储时间为70ns)中。存储地址由cpld构成的地址发生器产生，地址发生器产生的地址范围可由存储器的容量决定。地址产生器循环计数，数据循环存储。此间的运行完全不需要cpu控制，系统硬件可自动完成高速数据采集，使硬件的高速性能得到充分运用。cpu2采用ad公司的aduc812，它本身就是全集成的高性能12位数据采集系统，内部集成

  • 基于ADSP-TS101S的多芯片数字信号处理系统的实现方案

    标志的dsp得到了快速的发展和应用。本文基于adi公司的一款dsp —— tigersharc，比较详细地介绍了在信号处理系统中的一套具体实现方案。 图1 信号处理机结构框图 系统设计及各部分功能简介本系统是某雷达的信号处理机，通过adc读入中频数据，dsp1、dsp2完成数据的脉冲压缩和旁瓣抑制，dsp3、dsp4完成数据的积累和求模，dsp5实现视频数据的归一化、通过dac输出视频数据和发送并行数据。系统结构如图1所示。本系统中，adc采用具有12位有效数据位、25msps转换速率的ad9225，将i、q两路模拟信号以某一采样率转换为数字信号，高10位送至dsp。本系统采用tigersharc dsp，该芯片最高运行速度300mhz，内核指令周期3.3ns，每周期能够执行多达4条指令，24个16-bit定点运算和6个浮点运算，并包含6mb的片内sram，具有很高的存储和运算性能，在信号处理领域应用价值很高。为了简化系统硬件，减少dsp片间连线，系统的5个dsp以松耦合的链路方式进行连接。dsp1通过外部dma方式读入中频解调后的i、q路数据，dsp1对读入的部分数据进行脉冲压缩(匹配滤

  • AD9225

    AD9225引脚图单片的电路12位，25MSPS模数转换器；低功耗：280mW；单5V电源；无失踪码保证；微分非线性误差：±0.4LSB；完成对芯片采样保持放大器；电压参考；信号与噪声及失真率：71dB，无寄生动态范围：85dB； 直二进制输出数据；9Q引脚SOIC封装；28引脚SSOPP封装；兼容3V逻辑

  • 信号采集

    信号采集我用ad9225采集信号，信号的范围是（－10v－10v）采集之前通过直流与交流耦合的方式把信号变成了0－5v，但是参考电压的最大满量程才是0－4v，也就是说信号4－5v采不到，请问应该如何处理？

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