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具有PCI和并行接口的数据采集系统设计
pga进行存储。在fpga中设计了高速缓冲器dcfifo和高速存储器dpram以及一系列时序控制逻辑，以保证在预定容量下能够实时的存储由adc发送过来的数据。同时，在fpga中还设计了2种数据传输接口，从而使得系统可以在我们选择的模式下进行数据传输，或通过并行接口，或通过pci总线接口。图1 系统总体框图 2.2 模拟中频信号预处理模块首先，将该输入信号通过两级放大器，目的是为了使模拟输入信号幅度达到ad6644输入幅度的要求和对模拟输入信号进行很好的隔离。这里选用ad9618来实现对模拟信号的放大功能。ad9618的单位增益带宽和压摆率的指标均较高，能起到对模拟输入信号放大和改善性能的作用。电路图如图2所示。图2 两级ad9618放大器原理图其次，将经过放大处理后的单端信号通过ad8138，转换为差分信号后输出给ad6644。这么做是因为作为新型的高转换速度、大动态范围的adc，为保证其性能，ad6644的模拟输入信号要求差分形式。在模拟信号阶段使用差分形式，可以有效地滤除偶次谐波分量，同时对其它共模杂散信号(如由电源和地引入的噪声)及对晶振
基于ISA总线的高速同步数据采集系统设计
高速a/d转换 a/d转换采用闪烁adc器件ad9048，其最大转换速率为35msps，分辨率为8位。利用高速双极工艺制造，采样速率快，频带宽，无代码遗失，输入电容小（仅为16pf），功耗低（为500mw）。ad9048内部时钟锁定比较器可使编码逻辑电路和输出缓冲寄存器作在35msps的高速，并避免了多数系统对取样保持电路（s/h）和跟踪保持电路（t/h）的需要。数字输入、输出及控制电平与ttl兼容。ad589和ad741、2n3906等构成稳压可调电路，提供给9048的rb、rt接地。ad9618作为输入缓冲放大器[3]。由于ad9048的数据输出没有三态门控制，故在输出加上74ls241作三态门控制。ad9048是否工作取决于输入转换脉冲信号，在脉冲信号上升沿取样。转换脉冲来自采样频率控制电路中的8254分频器的输出。 1.2 高速寻址对于高速数据采集系统，a/d转换应不受cpu控制。每当adc转换一次后，由控制电路发出相应的信号，将adc转换结果写入高速缓存ram某单元中，再使地址计数器加1，直到地址计数器记满后产生采样结束信号，封锁ram写信号，利用二进制地址发生

具有跟踪-保持的中频(IF)信号采集电路(AD9100/AD9618)
相关元件pdf下载：ad9100 ad9618 如图所示为具有跟踪-保持的中频(if)信号采集电路。ad9100有着宽的动态范围，因此可以用于采集超级信号，直接将中频信号(if)变换为数字信号。中频信号输入ad9100后，由t／h时钟控制采样和保持，输出后由ad9618放大，再由adc电路将模拟信号转换为数字信号。用减小模拟信号输入电平的方法来实现跟踪和保持，并将失真减小到最小；同时调节ad9618增益，使输入到adc的模拟信号范围符合a／d变换器全刻度范围的模拟-数字转换。

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ad9618替代型号

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