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声低、易于用微机等多种方法控制以及体积小、集成度高等多种优点，因而近年来dds在理论和应用上得到飞速的发展。 dds的基本结构如图2所示。 由于dds具有频率和相位可以确定数控的特点，因而将dds器件作为成像声纳信号模拟器的关键部件，并辅以相应的控制和接口逻辑等，就可以实现对任意方位和距离目标回波的精确模拟。 2.2 dds构成的模拟器结构 基于dds技术的成像声纳信号模拟器的结构如图3所示。 模拟器共有48个信号通道，每个通道模拟声纳接收基阵中一个基元的输出。通道电路由单片dds器件ad9830及其接口逻辑电路、输出i-v变换器及滤波和跟随电路构成。各个通道的dds器件与cpld之间的接口采用16bit位宽的并行总线。 用户将要模拟的目标方位、距离、信号幅值等信息输入到主机的应用程序界面中，应用程序根据这些信息，按照近场聚焦的算法计算出每个通道信号相对于参考通道的相位差等参数，然后通过rs-232串行总线将这些参数下传到信号模拟器中。信号模拟器中的微控制器将这些参数接收并解码，并将每个通道信号的频率和相位等参数通过cpld写入相应通道的dds器件的控制寄存器中。ad9830初始化和参
线送入主存中，根据需要进行处理或存盘，从而完成数据采集过程。 2.2 元器件的选用 adc采用了模拟器件公司(adi)的ad9220子区式高速adc，分辨率为12bit，采样率最高为10msps，片内带有高速低噪声采样保持放大器和电压参考源，可以简化设计。采集卡中所有的控制和时序逻辑全部由一片fpga实现，综合考虑规模、速度、功耗等因素，选用了xilinx公司的xcs30。该器件为spartan系列fpga，成本低速度快，可用逻辑门数为30000门。采样时钟发生器中dds器件选用adi的ad9830单片dds集成电路，其最高时钟频率为50mhz，内置10bit d/a变换器，频率控制字长32bit，频率分辨率可达0.005hz，完全满足本设计的需要。pci总线控制器选用了cypress公司的cy7c09449（pci-dp），其特点是接口方式灵活，具备pci总线master能力，可以实现与主存或其他slave设备的dma传输，这对保证实时高速数据采集是十分必要的。 3 提高采集卡性能的措施 3.1采样时钟发生器中低通滤波器的设计 低通滤波器的性能对保证采样时钟具有较低的jitte
范围、频率分辨率、频率转换时间、频率准确度和稳定度、频谱纯度等。其中，跳频速度和频率点数是决定跳频通信系统性能的主要因素，系统的抗干扰和保密能力随频率点数的增高和跳速的加快而加强。从dds的特点可以看出，直接数字频率合成器各个性能指标都较高，特别是其频率转换速度，因此它是实现快速跳频频率合成器的最佳选择。3 基于dds的跳频频率合成器的设计下面将给出一种基于dds的快速跳频频率合成器的设计。3.1 dds芯片的选择现在流行的dds产品以analog devices公司的最多，主要有ad7008、ad9830～ad9835、ad9850～ad9854等十几种芯片，形成从0～120mhz的宽输出频率范围系列。此外，qualcomm公司也有q2334、q2368等产品。该方案使用analog devices公司推出的新一代dds芯片ad9952，该新芯片能以早期dds十分之一的功耗提供频率高达400mhz的内部时钟。此外，与以往的dds芯片相比，该芯片还具有以下优点：（1）内部集成14位的d/a转换器。以往dds芯片的a/d转换器最多为12位。（2）可进行sin(x)/x校正。通过反sin(x)/x函数
i总线送入主存中，根据需要进行处理或存盘，从而完成数据采集过程。 2.2 元器件的选用 adc采用了模拟器件公司(adi)的ad9220子区式高速adc，分辨率为12bit，采样率最高为10msps，片内带有高速低噪声采样保持放大器和电压参考源，可以简化设计。采集卡中所有的控制和时序逻辑全部由一片fpga实现，综合考虑规模、速度、功耗等因素，选用了xilinx公司的xcs30。该器件为spartan系列fpga，成本低速度快，可用逻辑门数为30000门。采样时钟发生器中dds器件选用adi的ad9830单片dds集成电路，其最高时钟频率为50mhz，内置10bit d/a变换器，频率控制字长32bit，频率分辨率可达0.005hz，完全满足本设计的需要。pci总线控制器选用了cypress公司的cy7c09449（pci-dp），其特点是接口方式灵活，具备pci总线master能力，可以实现与主存或其他slave设备的dma传输，这对保证实时高速数据采集是十分必要的。 3 提高采集卡性能的措施 3.1采样时钟发生器中低通滤波器的设计 低通滤波器的性能对保证采样时钟具有较低的jitter非
有谁用过ad9830的吗？哪位大虾有这方面的经验啊请赐教啊谢谢
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