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基于TMS320C6722的高速铁路信号发送与接收模拟系统
2.系统硬件分析系统的硬件整体框架图如图2所示。图2 硬件整体框架 2．1双cpu单元采用ti公司的浮点dsp处理器tms320c6722作为整个系统的核心，应用其出色的运算能力和数据处理速度快、精度高等优点，完成系统的数据处理任务。控制单元采用cortex－m3为内核的arm芯片stm32f103zet6作为核心，其强大的控制能力，满足了整个系统的控制要求；其丰富的外设配置，为系统的扩展和升级提供了很大的空间。 2．2主要外围电路单元 dds发送单元以ad9831为核心，配合相应算法及程序发送正交化fsk信号和数字编码信号。由于ad9831频率寄存器切换选择线（fselect）需由定时器的输出脉冲控制，以实现多频之间切换，而dsp芯片定时器未设置定时器的外部引脚，故dds的控制由协处理器stm32f103zet完成。信号采集单元以max1322为核心，通过并行数据线与tms320c6722相连，ad_e0c＃连接c6722的外部中断引脚，读写及片选由cpld逻辑译码产生。 2．3通信单元系统中dsp和arm之间采用双口ram（idt
基于DDS技术的电磁阀检测平台的设计
并且可以模拟斜坡信号，能产生可调占空比的方波信号，可调范围达1%~99%. 1 系统设计方案本文设计的数字信号源的系统框架如图1所示。本系统产生输出频率为0~25 khz,最小精度为1 hz的信号，占空比在0~100%范围内可调，变化周期为10 s的整数倍。系统输出电压vout范围0~40 v,最小精度0.01 v,输出电流最大可达10 a,方波低电压可词范围0~10 v,并且波形较好，可以连续变化，误差不超过1%. 单片机完成键盘扫描和按键处理，通过spi总线对ad9831进行控制处理，通过ad7541进行采样处理。系统中的cpld完成对单片机的扩展和测频功能。单片机发出的指令通过cpld控制dds以完成信号的产生。 2 模块电路设计 2.1 控制系统单片机控制整个系统工作，采用12 mhz晶振，p1.0、p1.1、p1.2、p1.3、p1.4、p1.5接一块3x3矩阵键盘，p0口为扩展接口，连接一块8255芯片扩展端口，并且同时连接lcd的db0、db1、db2、db3、db4、db5、db6、db7数据控制端口。p2.3、p2.4、p2.5

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