EP1C6T14417
38928
100TQFP/21+
原厂渠道,现货配单13312978220
EP1C6T14417
6500
QFP/21+
原装正品
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6500
QFP/23+
原装
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68900
1535/-
原包原标签100%进口原装常备现货
EP1C6T14417
6500
QFP/23+
原装
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21409
1535/22+
原厂原装现货
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21409
1535/22+
原厂原装现货
EP1C6T14417
6400
-/22+
深圳贸泽,最新到货,原厂渠道,只有原装
EP1C6T14417
360
QFP/19+
专订原装ALTERA销售并收购15915481688
EP1C6T14417
2350
QFP/2022+
一级代理,原装正品假一罚十价格优势长期供货
EP1C6T14417
8000
22+/NA
-
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9861
-/21+
13年行业经验原装订货自营库存
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6500
QFP/21+
原装正品
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6656
TQFP/-
全新原装
EP1C6T14417
300
-/19+
回收原装IC库存,只做全新原装
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3588
-/-
原装 部分现货量大期货
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300
QFP/2020+
原装现货有意者请来电或QQ洽谈
EP1C6T14417
6000
QFP/-
认证会员原装现货,长期供应账期服务
EP1C6T14417
96340
TQFP/-
原装现货价格优势假一赔十
EP1C6T14417
1535
500/-
原装现货 欢迎来电询价
的主要任务包括:(1).产生两路同频率的本振信号;(2).保证两路本振之间的相位差是可控的;(3).保证两路本振的频率可同时更改。 本设计中,在dds原理的基础上添加了频率控制字生成电路,相位差控制字生成电路,并生成两路对应于同一频率但对应于不同相位的相位累加值,使用这两路相位累加值作为地址分别查正弦表,再分别进行dac转换和滤波,则得到两路同频率且具有特定相位差的正弦信号。其原理框图如图3所示. 图3 dds系统结构设计图 设计中采用altera公司的fpga芯片cyclone ep1c6t14417、以及cyclone ep1c6t14417的配置芯片、ad公司的高速dac ad5447yru来实现dds芯片的功能,累加速度为40mhz,相位累加器的位数为48-bit,截取高13-bit作为ram查找表的地址,波形数据存储深度为2k*12bit(存放1/4个周期的波形数据),dac精度为12-bit。 2.2.2 dds中的相位累加器设计 相位累加器是dds的核心,如何保证高的累加速度是一个关键的问题。为了进一步提高速度,设计相位累加器模块时并没有采用fpga单元库中的48位加法器,