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合适的配置方案是利用fpga进行设计的一个重要环节。altera公司的fpga共有多种配置方案，其中fpp、as、ps、ppa和jtag 配置方案适用于stratix ii系列fpga。本设计采用了一种advanced configuration combine的配置方案。因为在系统研发阶段，考虑到要频繁地向fpga写入设计文件，和ep2s30f484直接相连的标准jtag必不可少，bytemastermv下载线一端接pc的并口，另一端与板上引出的jtag底座连接。存储配置数据并完成自动配置的是epcs16，它是altera专为stratixii设计的增强型配置器件。当设计完成后，利用bytemastermv下载线直接将quartusii输出的配置信息直接写入增强型配置器件中，以后在独立工作状态下，系统一上电启动，就开始了as(fast)方式的自动配置。 使用jtag配置电路时，主要用到4个必需的管脚：tdi、tdo、tms和tck及一个可选的管脚trst。在电路板上，要根据jtag 标准的要求，引出2×5的jtag底座。要注意的是，tms和tdi管脚必须接1kω的上拉电阻。 quartusi
3．3 v，为将i／o电压升压到5 v，在这里使用74hct245升压芯片。 2)时钟和复位电路的设计 时钟电路中用zpb-26-16m作为有源晶振。它的频率为16m，这使得串口波特率更加精确，同时可以支持芯片内部的ppl功能及isp下载功能，使系统运行速度更快，更方便程序调试下载。复位电路采取硬件复位和软件复位。 3)调试jtag和下载电路fpga 内部可以直接搭建软核。isp和jtag，所以在硬件电路接一个idc-10的jtag接口即可满足要求。 4)配置存储电路 选epcs16作为fpga的rom，可以由下载电缆或其他设备进行重复编程，也可以通过as接口进行在线系统编程。用fpga芯片内部自带的4m的on-chip memory作为fpga的ram。 5)声光报警电路 声光电路主要由发光二极管和蜂鸣器组成，直接接入fpga，来提醒洗衣机的工作状态。 6)时间输入和显示电路 利用4个按键输入洗涤时间，两个数码管显示设定时间。有关设定洗涤时间是由fpga内部的定时器计时的，计时完成洗涤结束。 7)模式选择和中断控制 模式选择主要通过3个按键输入洗涤
发送数据，从而完成对fpga的重新配置。 本设计是通过dsp处理器来接收pc主机的fpga配置数据流，并开发cpld器件以实现控制逻辑，最终把所需的fpga配置数据流存储到支持as配置模式的epcs配置芯片中，并实现fpga配置数据流的更新，从而达到fpga的重新配置，实现整个系统的可重构。其可重构电路由dsp与cpld串行通讯电路、cpld读写epcs配置芯片电路和epcs配置fpga电路组成。 2．2 epcs配置器件 fpga的串行配置芯片主要包括epcs1，epcs4，epcs16，epcs64，epcs128等。它们的主要区别是容量不同，分别为1 m，4 m，16 m，64 m，128 m bits的容量，可配置的fpga器件也有所不同，用户可根据不同需求来选择。epcs配置芯片的擦除或编程次数可以达到十万次左右，一般情况下足以满足用户需求。epcs器件电平的选择包括3．3 v、2．5 v、1．8 v、1．5 v，主要可参考对应的fpga所用i／o bank的vccio引脚电平的选择。 epcs芯片的内部结构框图如图1所示，epcs配置器件与所配置的fpg
有以上优点,本设计中pci express接口部分采用四周期突发模式dma块传输模式，local总线接口采用c模式。 2.3 fpga逻辑控制 在本设计中fpga采用了altera公司的cycloneii系列的 ep2c20f484芯片,这款芯片具有484个io引脚，其中可用io引脚315个,具有68 416个逻辑单元，有1.1 mbit的ram可利用,可变的端口ram配置×1,×2,×4,×8,×9,×16,×18,×32和×36。对ep2c20f484芯片配置可以使用epcs4、epcs16。在本设计中采用epcs4对ep2c20f484芯片配置。其配置原理图如图4所示。 在上面的配置原理图中有两个下载口：一个是jtag下载口，一个是as下载口。其中jtag下载口是用来下载.sof文件的，下载.sof文件后可以使用quartus ii 6.0的逻辑分析仪进行在线调试；另一个下载口是下载.pof文件的,其作用是把程序烧写进epcs4配置芯片，在fpga每次加电开始工作之后，把程序导引到fpga的内部ram中，使器件实现设计者要求的逻辑功能。 fpga作为本地总线的逻辑
合适的配置方案是利用fpga进行设计的一个重要环节。altera公司的fpga共有多种配置方案，其中fpp、as、ps、ppa和jtag 配置方案适用于stratix ii系列fpga。本设计采用了一种advanced configuration combine的配置方案。因为在系统研发阶段，考虑到要频繁地向fpga写入设计文件，和ep2s30f484直接相连的标准jtag必不可少，bytemastermv下载线一端接pc的并口，另一端与板上引出的jtag底座连接。存储配置数据并完成自动配置的是epcs16，它是altera专为stratixii设计的增强型配置器件。当设计完成后，利用bytemastermv下载线直接将quartusii输出的配置信息直接写入增强型配置器件中，以后在独立工作状态下，系统一上电启动，就开始了as(fast)方式的自动配置。 使用jtag配置电路时，主要用到4个必需的管脚：tdi、tdo、tms和tck及一个可选的管脚trst。在电路板上，要根据jtag 标准的要求，引出2×5的jtag底座。要注意的是，tms和tdi管脚必须接1kω的上拉电阻。 quartusi
到fpga中，再仿真cap嵌入式金属可编程(mp)模块的功能。 这套cap入门工具包基于单一的pcb板，含有以at91cap9s arm926ej-s为基础的微控制器、64mb sdram应用内存、512mb nand闪存、高达8mb的dataflash(这是选件)，并提供支持以太网、usb控制器和usb器件、带触屏功能的1/4 vga lcd显示屏、sd卡，4个模拟输入和耳机等的各种外部接口，以及一块作为承载主体的altera stratix 2 ep2s15f484 fpga和配套的epcs16串行配置存储器。该fpga可提供15,600个四通道输入查询表 (lookup table, lut) 等效值，对应于cap金属可编程模块中约124,800个栅极。板卡上的at91cap9s具有64个通用i/o连接，而其上的fpga则有两组64个i/o的外设组件，均可用于实现面向特定应用的外部接口。此外，通过一个用于cap9 jtag编程的ice-jtag接口和一个用于stratix2 jtag 编程的usb-blaster-jtag接口，就可以进行调试。cap入门工具包还含有爱特梅尔的at73
ap 嵌入式金属可编程 (mp) 模块的功能。 这套cap 入门工具包基于单一的 pcb 板，含有以 at91cap9s arm926ej-s 为 基础的微控制器、64mb sdram应用内存、512mb nand闪存、高达8mb的dataflash (这是选件)，并提供支持以太网、 usb 控制器和usb器件、带触屏功能的 vga lcd显示屏、sd卡，4个模拟输入和耳机等的各种外部接口，以及一块作为承载主体的 altera stratix 2 ep2s15f484 fpga和配套的 epcs16 串行配置存储器。该fpga可提供15,600个四通道输入查询表 (lookup table, lut) 等效值，对应于cap 金属可编程模块中约124,800 个栅极。板卡上的at91cap9s具有64个通用i/o连接，而其上的 fpga 则有两组 64 个 i/o 的外设组件，均可用于实现面向特定应用的外部接口。此外，通过一个用于cap9 jtag 编程的 ice-jtag 接口和一个用于stratix2 jtag 编程的 usb-blaster-jtag 接口，就可以进行调试。cap 入门
ip构件映射到fpga中，再仿真cap嵌入式金属可编程(mp)模块的功能。 这套cap入门工具包基于单一的pcb板，含有以at91cap9s arm926ej-s为基础的微控制器、64mb sdram应用内存、512mb nand闪存、高达8mb的dataflash(这是选件)，并提供支持以太网、usb控制器和usb器件、带触屏功能的vga lcd显示屏、sd卡，4个模拟输入和耳机等的各种外部接口，以及一块作为承载主体的altera stratix 2 ep2s15f484 fpga和配套的 epcs16串行配置存储器。该fpga可提供15,600个四通道输入查询表(lookup table, lut)等效值，对应于cap金属可编程模块中约124,800个栅极。板卡上的at91cap9s具有64个通用i/o连接，而其上的fpga则有两组64个i/o的外设组件，均可用于实现面向特定应用的外部接口。此外，通过一个用于cap9 jtag编程的ice-jtag接口和一个用于stratix2 jtag编程的usb-blaster-jtag接口，就可以进行调试。cap入门工具包还含有爱特梅尔的at73c22
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