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基于TMS320C6722的高速铁路信号发送与接收模拟系统
831为核心，配合相应算法及程序发送正交化fsk信号和数字编码信号。由于ad9831频率寄存器切换选择线（fselect）需由定时器的输出脉冲控制，以实现多频之间切换，而dsp芯片定时器未设置定时器的外部引脚，故dds的控制由协处理器stm32f103zet完成。信号采集单元以max1322为核心，通过并行数据线与tms320c6722相连，ad_e0c＃连接c6722的外部中断引脚，读写及片选由cpld逻辑译码产生。 2．3通信单元系统中dsp和arm之间采用双口ram（idt70v24）通信。该芯片配有两套完全独立的数据线、地址线、读／写控制线，允许主从控制器对双端口存储器的同一单元进行同时存取。两套完全独立的中断逻辑用来实现两个cpu之间的握手控制信号；两套独立的“忙”逻辑，保证两个cpu同时对同一单元读／写操作的正确性；读／写时序与普通单端口存储器完全一样，存取速度完全适合高速、实时的通信系统。 pc和arm之间采用usb或rs－232串口通信。 2．4 cpld模块采用atmel公司的cpld芯片atf1508ad完成对整个系统的时序控制和硬件接口逻
基于双DSP的磁悬浮控制器的设计
―0x100000）开始，每个片选信号占用0x800的地址空间。磁悬浮系统中，根据需要选择的数模转换器是ti公司的dac7625u。虽然dac7625供电电压是5v，但是数据的传递方向是从dsp到转换器，故不需要另加电压转换电路。dac7625四个输出通道占用了dsp从cs7开始的四个存储单元。双口ram以其双接口、大容量、超高速的数据交换所提供的优势作为双dsp之间数据传递的交换场地是很好的选择。由于tms320vc33和tms320f2812的接口都是3.3v，故选择了3.3v的双口ram idt70v24，这样就不必加电压转换模块，简化了系统之间的接口，提高了可靠性，见图2。对于tms320f2812，由于它有非常多的功能模块在磁悬浮控制系统的电路板中没有用，故可以把那些没有用的功能引脚作为通用输入输出引脚（gpio），引入开关和发光二极管。为了保护处理器，加入了lvth16245作为隔离以及方向控制芯片，开关量为输入量，发光二极管为输出量。硬件原理框图见图3。ti的tps767d318可以通过5v稳压电源，提供dsp内核所需的1.8v电压和dsp的外设及lvth16245等芯片构成的电路所需的

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