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基于PCI总线数字信号处理机的硬件设计
6aars的busy信号引入到cpld，用于锁存a/d转换数据。运放与a/d的电路结构如图2：系统采用1片cpld（emp3256）作a/d转换输入数据锁存、产生dsp所需的复位信号等。同时，cpld还要完成pci桥的一些控制信号的生成、转接。实际上也就是作为pci局部总线的仲裁器，它对pci接口芯片和dsp提出的占用局部总线的请求进行仲裁，协调它们之间的逻辑关系，使局部总线上的操作顺利进行。系统还采用了两片16k×16位的双口ram idt70v261来构成dsp信号处理机与pci的接口，其中ram1作数据输入，ram2作数据输出。 pci桥采用pci 9054完成，pci 9054是plx technology公司的较新产品，是一低成本，低功耗，功能较强的pci桥芯片，可以连接pc机的pci总线和局部总线，是先进的pci i/o加速器，采用了先进的plx数据流水线结构技术，是32位、33mhz的pci总线主i/o加速器；符合pci本地总线规范2.2版，有m、c、j三种模式；针对不同的处理器及局总线特性可选，尽量减少中间逻辑；具有

基于PCI总线数字信号处理机的硬件设计
期由dsp的定时器控制，可以实现周期可调的。又将ad976aars的busy信号引入到cpld，用于锁存a/d转换数据。运放与a/d的电路结构如图2：系统采用1片cpld（emp3256）作a/d转换输入数据锁存、产生dsp所需的复位信号等。同时，cpld还要完成pci桥的一些控制信号的生成、转接。实际上也就是作为pci局部总线的仲裁器，它对pci接口芯片和dsp提出的占用局部总线的请求进行仲裁，协调它们之间的逻辑关系，使局部总线上的操作顺利进行。系统还采用了两片16k×16位的双口ram idt70v261来构成dsp信号处理机与pci的接口，其中ram1作数据输入，ram2作数据输出。 pci桥采用pci 9054完成，pci 9054是plx technology公司的较新产品，是一低成本，低功耗，功能较强的pci桥芯片，可以连接pc机的pci总线和局部总线，是先进的pci i/o加速器，采用了先进的plx数据流水线结构技术，是32位、33mhz的pci总线主i/o加速器；符合pci本地总线规范2.2版，有m、c、j三种模式；针对不同的处理器及局总线特性可选，尽量减少中间逻辑；具有可选的串

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