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一种基于高速数字信号处理器TMS320VC5410DSP和CPLD的图像采集、压缩系统
码a/d芯片philips saa7113将模拟视频电视信号（本系统pal制）数字化。输出为符合ccir.601标准的数字视频码流。（3）fifo al422b作为a/d与vc5416dsp之间的数据缓冲，使a/d的转换速度与dsp读取a/d数据的速度匹配。（4）tms320c5410 dsp为主处理器，实现对视频数据的压缩编码处理。在存储fifo、存储sdram和压缩码流输出sdram采用dma方式进行数据传输，可以提高数据传输的速率。（5）cpld采用laitiice公司的isplsi2064ve为系统协处理器，作为视频a/d对fifo进行写操作，dsp对fifo进行读操作的时序控制。（6）flash 采用芯片256 k×16 bit的am29lv400b，用于dsp上电或复位后的程序加载。（7）sdram作为dsp的片外扩展存储器，用于存储a/d的图像数据、中间过程的部分数据以及压缩后的图像数据。选用了4片issi公司的4 m×16 bit sdram芯片is42s16400，构成了一个8 m×32 bit的外部存储器。 1.图像采集与存储关键问题与解诀方法计算机