SA160A
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部电阻相并联,从而将端接电阻调整到75 。每个收发器都有一个时钟与数据抖动抑制器,通过"licr"寄存器的"jas"位(即d3位),可以将其配置到发送通路中,也可以配置到接收通路中,用于从发送或接收信号中消除相位抖动。也可以选择不用此项功能。"outa"和"outb"是用户选用输出口,根据需要可灵活配置。通过控制"outac"寄存器,可以使outa口输出cmi码,用于直接驱动光接口。寄存器sa1~sa16用于存储发送和接收信令。接收信令时,信令数据从接收的e1数据流ts16时隙取样得到,暂存到接收信令缓冲器,主机通过对sa1~sa16的读操作,得到信令数据。发送信令时,往sa1~sa16中写入数据,在控制寄存器"ccr6"的d3位为"1"时,将发送缓冲器的信令数据插入到发送数据流的ts16时隙中。片内的系统时钟合成器能够产生2.048mhz、4.096mhz、8.192mhz及16.384mhz等频率的时钟,既为每个收发器提供时钟,还可以为多路e1信号的交
m寻址的地址线sa19~sa0,还要采用1 m外寻址的地址线la23~la17。需要注意的是,pc104的总线上的sa19~sa17与la19~la17是重复的。区别在于sa10~sa0是通过总线地址锁存使能信号bale锁存输出,而la19~la17未经锁存,为保证在对ram访问期内地址信号一直有效,至少应在cpld内将la23~la20进行bale锁存。本文中将ram的地址安排在1 m地址空间外从100000 h开始的64 k偶地址。所有需要用到的pc104信号线都连接到cpld,cpld将sa16~sa1缓冲连接到ram,其余地址线译码产生ram左端口选通信号。pc104与cpld连接的访问逻辑如图2所示。 其中有效表示数据总线的高8位有效,sa0有效表示数据总线的低8位有效,作为译码信号的一部分,对于单片16位数据线的集成电路,实际上也可以不连接,用sa0和高端地址线译码产生选片信号。aen信号有效表示计算机在和某个设备进行dma传送,其他的设备发现aen信号有效,就不要响应寻址信号。因此在cpld内部逻辑里设置当aen信号有效时,将进入cpld的地址信号线置为高阻态。
在提供给存储器的sa0~sa15地址中加人缓冲器。缓冲器利用74ls244也可以,但因为741ls245布线简单,所以通过74ls245可单向使用。 2. 数据缓冲器 因为数据需要双向进行,所以要利用74ls245进行接收。将栅极一直打开,通过对存储器的读信号来进行方向控制。本次我们采用将pld上存储器的读信号设置为只在cs1有效时才输出的方法。 3. pld(memdec) ld应用于生成对存储器的片选、de以及we信号中。片选信号是在刷新周期以外、当地址高位(sa16~sa19)为dh(将d0000h~dffffh设置在sram主板空间)、且bale为低电平时被选择的。 将存储器的读/写信号设置为当片选和smemr/smemw有效时输出。 4. 各份电源的切换 电池各份的重点在于电源切换和片选信号的控制。本次为了简单起见,只单纯获取vcc和电池(为cn2提供3.6v的电池)的二极管or,但需要注意二极管正向电压降。如果电源电压比所提供的电压低很多,则可能发生超出操作电压或者输入引脚的电压高于电源电压的情况。 5. 片选控制 为
tl8019as的总线接口是与isa总线兼容的,虽然不能与c5402的外部总线直接接口,但是只要进行一些简单的逻辑变换就可以了。另外,c5402的总线电平是3.3v的,而rtl8019as的接口电路是5v的,二者接口时要使用电平转换器。c5402与rtl8019as的接口如图2所示。 (1)地址总线 rtl8019as的20根地址线主要是为了读/写自举rom,对于i/o端口寻址来说只要16根地址线就足够了,因此将dsp的地址总线a0~a15与rtl8019as的地址总线sa0~sa15相连,而sa16~sa19全部接地。由于dsp系统无dma控制器,因此将rtl8019as的aen引脚也接地。 (2)数据总线rtl8019as的iocs16引脚接高电平,选择16位数据总线方式,并且使用了电平转换器。 (3)中断连接 虽然rtl8019as有7个中断输出,但只要从中选择一个送往c5402的外部中断输入口就可以了。中断接口也使用了电平转换器。 (4)读/写控制c5402的i/o口控制信号is、iostrb、r/w等信号经过74hact139译码后与rtl8019as的ior、iow连接。由
瞬态电压拟制二极管,21.8V,1.0A,500W电流参数:IT=1mA/IPPM=17.7A/IR=3μA电压参数:URWM=16V/UBR=17.8~21.8V/UC=28.8V功 率:PPPM=500W备 注:瞬态电压抑制二极管