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Dual JK flip-flop with reset; negati...
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0、inqf1，置位时分别表示中断时间匹配。涓流充电寄存器（读11h，写91h）控制涓流充电的特性。 ds1305标准三线模式的读写操作过程，每个字节需要16个sclk时钟。通过ce引脚输入高电平来启动所有数据传送，前8个sclk周期为输入写命令，后8个sclk周期为输入或输出的数据。输入时，sclk的上升沿数据有效；输出时，sclk的下降沿输出数据有效。2 用ds1305开启数据采集系统 图3所示的电路是利用ds1305组成的数据采集系统。89c51与ds1305使用标准三线形式进行通信，74hc73为jk触发器，输入端j、k、cd接高电平，时钟clk接ds1305的中断引脚int0，输出引脚q与三极管组成数据采集系统的开关。此外，ds1305在主电源断电时，可自动转换使用备用电池继续供电，不会造成时钟的丢失。 在采集系统上电初始化时钟芯片后，通过i/o口给jk触发器clk引脚一个负脉冲，q引脚输出为低，三极管截止，采集系统断电，功耗降到零。但时钟电路部分保持供电，在ds1305实时时钟到设定采集时间，由int0引脚发出中断信号给触发器clk一个低电平。由于cd维持高电平，造成jk触发器翻
冲来到之后的状态，称为次态。 图l jk触发器符号 表1 jk触发器的状态表 jk触发器的特性方程为 jk触发器的种类很多，有双jk触发器74ls107，双jk触发器74ls114，741s112，74hc73，74hct73等，有 下降沿触发的，也有上升沿触发的。图l所示的jk触发器是下降沿触发的。 （2）双jk触发器74ls76 74ls76是有预置和清零功能的双jk触发器，引脚如图2所示，有16个引脚。功能表见表2，74ls76是下降 沿触发的。 图2 74ls76引脚图
JK触发器(双列14脚)
transceiver 八路三态收发器74hc640 3-state transceiver 反向3态收发器74hc643 3-state transceiver 八路三态收发器74hc646 non-invert bus transceiver 总线收发器74hc648 invert bus tranciver 反向总线收发器74hc688 8bit magnitude comparator 8位判决电路74hc7266 2-input exclusive nor gate 异或非门74hc73 dual j-k flip-flop w/clear 双jk触发器74hc74a preset/clear d flip-flop 双d触发器74hc75 4bit bistable latch 4位双稳锁存器74hc76 preset/clear jk flip-flop 双jk触发器74hc85 4bit magnitude comparator 4位判决电路74hc86 2input exclusive or gate 2输入异或门74hc942 baud
这个时钟电路怎么频率不对？这是从mc145481的数据手册截下来的电路，用示波器测试发现输出的2.048mhz正常，但本来该出8khz的时钟测出4k来，会是什么原因？我用3.3v供电，查过74hc4060和74hc73的数据手册，可以在2v下工作的。 * - 本贴最后修改时间：2007-2-3 17:17:29 修改者：ocon
74hc73可以用什么cd系列的芯片代替？工作在2兆的频率。
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