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,fpga读取fifo中的数据写入flash存储器中。该设计方案选用fpga作为主模块,主要是考虑fpga现场可编程特性,使用灵活方便,能够降低硬件电路设计难度。 2.2 系统硬件设计 多通道同步数据采集存储系统结构框图如图1所示,主要包括以下部分: (1)多通道同步数据采集模块 选用ad781采样保持器完成多通道数据采样保持,满足系统要求。a/d转换器选用16位的ads8401,可提高采样精度,有利于分析采集数据。 (2)大容量存储模块 采用sumsung公司的k9k8g08u0m型flash作为存储器,使用idt7206作为采集数据缓存。 (3)外围电路 主要包括晶振、电压转换器tps70358及输入输出接口等。 其中,系统采集的重点是实现多通道数据的同步实时采集,其主要逻辑由fpga主控模块控制。存储模块中所采用的坏块检测技术,可提高flash存储的可靠性。 3 多通道同步数据的采集 在执行多通道同步数据采集时,其电路如图2所示。其主要工作流程:多路模拟信号经运放调理电路后进入采样保持器。在每个周期的开始,fpga通过编程输出脉冲至采样保持器(
电源电压:Vcc=2.7~3.6V; 结构:存储器单元阵列:(1G+32M)×8位,数据存储器:(2K+m)×8位; 自动编程和擦除:页编程:(2K+64)字节,块擦除:(128K+4K)字节; 页读操作:页大小:(2K+64)字节,随机存取:20μS(最大值),串行访问:25ns(最小值); 快速写周期时间:编程时间:200μs(典型值),块擦除时间:1.5ms(典型值); 指令/地址/数据复用I/O端口; 硬件数据保护:在电源转换过程中编程/擦除锁定; 可靠的CMOS准浮棚技术,100k次编程/擦除周期,10年的数据保留时间; 指令存储器操作; 封装:48引脚的TSOP封装