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异步FIFO和PLL在高速雷达数据采集系统中的应用

来的数据采集系统，且使用高速缓存后数据采集速率可达所采用的a／d转换器输出的最高速率，能充分发挥dsp算法处理功能强大、速度高的优势。而采用cycloneⅲfpga设计高速缓存，设计灵活、通用性强。整个系统具有实时性高、体积小、开发周期短、易于维护和扩展、适于实时信号处理等多个优点。高速雷达数据采集系统的设计主要包括高速a／d转换电路、读写控制逻辑电路、由双时钟fifo构成的高速缓存电路、锁相环、外部有源品振等，尽量选用高速器件以提高数据采集系统的瞬时带宽和存储深度。 高速a／d转换器采用max101a，其最高采样速率可达到500 ms／s，采样精度为8 bit，该器件属于直接转换式模数转换器即flash a／d转换器，其特点是速度快，内置1．2 ghz带宽的采样保持放大器，特有的量化设计使其具有较好的动态特性。如果采集系统需更高的采样速率，可使用多片a／d交替采样。fpga采用ep3c120，ep3c120利用65 nm低功耗工艺，不但实现低功耗，还具有丰富的逻辑(120 kb逻辑单元)、存储器(高达4 mbit)，及数字信号处理资源(288个dsp乘法器)。ep3c120的低功耗特性和其大