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引言对毫米波雷达回波信号的处理一般可以分为数字采样和信号处理两部分，其中数字采样的精度和性能将直接影响到信号处理得输出结果，因此，越来越多的雷达系统需要高带宽、高量化精度的a/d转换，毫米波雷达也不例外，adc是对雷达回波进行数字化处理得前端，是信号处理与外界信息相连的桥梁，其性能也是影响和制约雷达整体性能的关键因素之一。由于雷达信号频带宽，动态范围大，数据处理实时性要求高，所以必须选择高速a/d变换器，而ad9481频带宽，噪声低，转换速度快，尤其是差分信号动态性能突出，同时采用a、b两路输出的结构，提供有2个彼此反相的时钟（dco+和dco-），以便后续设备锁存数据。因此，其数据输出速率降低了一倍，从而降低了对存储器的读写速度要求，由此可见，选用此芯片进行采样系统的设计有着重要的现实意义。系统结构和工作原理本系统是基于某毫米波测量雷达，该雷达接收机可输出正交的i、q双通道零中频、200mhz带宽的模拟信号，以及220mhz采样时钟信号和推移信号。整个数字采样系统由ad9481芯片、cpld和cpci总线构成，其中多路数据的传输采用fifo缓存，双通道高速采样的难度在于要在较高采样频率基础上，应
引言 对毫米波雷达回波信号的处理一般可以分为数字采样和信号处理两部分，其中数字采样的精度和性能将直接影响到信号处理得输出结果，因此，越来越多的雷达系统需要高带宽、高量化精度的a/d转换，毫米波雷达也不例外，adc是对雷达回波进行数字化处理得前端，是信号处理与外界信息相连的桥梁，其性能也是影响和制约雷达整体性能的关键因素之一。 由于雷达信号频带宽，动态范围大，数据处理实时性要求高，所以必须选择高速a/d变换器，而ad9481频带宽，噪声低，转换速度快，尤其是差分信号动态性能突出，同时采用a、b两路输出的结构，提供有2个彼此反相的时钟（dco+和dco-），以便后续设备锁存数据。因此，其数据输出速率降低了一倍，从而降低了对存储器的读写速度要求，由此可见，选用此芯片进行采样系统的设计有着重要的现实意义。系统结构和工作原理 本系统是基于某毫米波测量雷达，该雷达接收机可输出正交的i、q双通道零中频、200mhz带宽的模拟信号，以及220mhz采样时钟信号和推移信号。整个数字采样系统由ad9481芯片、cpld和cpci总线构成，其中多路数据的传输采用fifo缓存，双通道高速采样的难度在于要在较高采样频
据采集的速度和性能。而fpga与单片机相比，有着频率高，内部延时小，内部存储容量大等优点，比单片机更适应与高速数据采集的场合。fpga（field－programmable gate array），即现场可编程门阵列，它是在pal、gal、cpld等可编程器件的基础上进一步发展的产物。它是作为专用集成电路（asic）领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。因此，本文介绍了一种基于fpga来实现高速数据采集的方法，a／d转换器使用ad公司的ad9481，fpga使用altera公司的ep2c5q208，存储器使用hynix公司的hy57v641620。系统框图如图1所示。 fpga采用了逻辑单元阵列lca（logic cell array）这样一个概念，内部包括可配置逻辑模块clb（configurable logic block）、输出输入模块iob（input output block）和内部连线（interconnect）三个部分。 现场可编程门阵列（fpga）是可编程器件。与传统逻辑电路和门阵列（如pal，gal及cpld器件）
dc并行采样的方式来提高系统的实时采样率。 多片adc芯片并行采样的方式可以弥补单片adc芯片采样率低的不足。通过对adc芯片时钟的精确控制，可使采样系统在单位时间内获得更多的样本信息。理论上，如果单片adc芯片的采样速率是f，那么通过m片adc芯片的并行采样，可以实现m·f的采样率。多片adc并行采样的结构框图如图4所示。 3 系统实现及时钟芯片配置 如上所述，利用m片adc芯片理论上可以把采样率提高到单片adc的m倍。那么利用4片采样率为250 msps的adc芯片ad9481，可以把采样率提高到1 msps水平。其中时钟芯片的配置是设计的重要环节。 ad9510是有美国模拟半导体公司推出的一款精确时钟分配芯片。它具有2路1．6 ghz的差分时钟输入、8路时钟输出以及片上pll核。其中，包括4路独立的1．2 ghz lvpecl时钟输出。另外4路独立的时钟输出可设置成lvds或cmos：设置成lvds输出时，频率可以达到800 mhz；设置成cmos输出时，频率可以达到250 mhz。同时，该款芯片还能通过spi串行编程来控制输出时钟间的相位延迟，且抖动和相位噪
c并行采样的方式来提高系统的实时采样率。 多片adc芯片并行采样的方式可以弥补单片adc芯片采样率低的不足。通过对adc芯片时钟的精确控制，可使采样系统在单位时间内获得更多的样本信息。理论上，如果单片adc芯片的采样速率是f，那么通过m片adc芯片的并行采样，可以实现m·f的采样率。多片adc并行采样的结构框图如图4所示。 3 系统实现及时钟芯片配置 如上所述，利用m片adc芯片理论上可以把采样率提高到单片adc的m倍。那么利用4片采样率为250 msps的adc芯片ad9481，可以把采样率提高到1 msps水平。其中时钟芯片的配置是设计的重要环节。 ad9510是有美国模拟半导体公司推出的一款精确时钟分配芯片。它具有2路1.6 ghz的差分时钟输入、8路时钟输出以及片上pll核。其中，包括4路独立的1.2 ghz lvpecl时钟输出。另外4路独立的时钟输出可设置成lvds或cmos：设置成lvds输出时，频率可以达到800 mhz；设置成cmos输出时，频率可以达到250 mhz。同时，该款芯片还能通过spi串行编程来控制输出时钟间的相位延迟，且抖动和相位噪
引言
对毫米波雷达回波信号的处理一般可以分为数字采样和信号处理两部分，其中数字采样的精度和性能将直接影响到信号处理得输出结果，因此，越来越多的雷达系统需要高带宽、高量化精度的A/D转换，毫米波雷达也不例外，AD...
引言
对毫米波雷达回波信号的处理一般可以分为数字采样和信号处理两部分，其中数字采样的精度和性能将直接影响到信号处理得输出结果，因此，越来越多的雷达系统需要高带宽、高量化精度的A/D转换，毫米波雷达也不...
DNL＝±0.35LSB；INL＝±0.26LSB；单3V电源操作(3.0～3.6V)；功耗439mW在250MSPS；1V(峰-峰值)模拟输入范围；内部1.0V参考；单端或差分模拟输入；CMOS输出；掉电模式；时钟周期稳定器
ad采样偏差（王兄请进）王兄，你作过11g的，有经验。我现在在做一实时采样率为1gsps的，用的ad9481，但是我搭样调试发现9481有7mv的偏差，请问如何消除？你作过偏差消除方面的没，我的联系邮箱为：laoluo12345678@yahoo.com.cn,敬候指教另有一问题，我用的是四片9481级联，以前用的是单片的，请问级联有哪些方面需要特别注意的。
王兄，ad采样偏差请教王兄，你作过11g的，有经验。我现在在做一实时采样率为1gsps的，用的ad9481，但是我搭样调试发现9481有7mv的偏差，请问如何消除？你作过偏差消除方面的没，我的联系邮箱为：laoluo12345678@yahoo.com.cn,敬候指教另有一问题，我用的是四片9481级联，以前用的是单片的，请问级联有哪些方面需要特别注意的。
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