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PXI总线数字输入/输出模块的设计与实现
i总线数据直接输入。pxi总线数据通过软件的读操作。直接访问输入触发器，而不是读取静态存储器存储的响应数据。数字输入/输出模块使用的激励或响应时钟经pxi局部总线加到时钟选择单元。当通道定义为输出时，通过多路选择器选择六路时钟信号中的一个，加到输出通道上；当通道定义为输入时，则选择响应时钟。激励时钟和时钟由时钟模块产生，响应时钟是激励时钟经n×6.25ns的延时所得，以补偿激励信号经被测电路和往返通道所产生的延迟。同时，同一时钟信号加到同一模块的不同输出端，也会产生传输延迟，采用可编程延时器ad9500产生精确延迟时间，补偿不同通道间的传输延迟。延迟补偿电路采用motorola公司的mc10h系统的ecl电路，具有速度快、逻辑功能强、扇出能力高、噪声低、引线串扰小和自带基准源等优点。先将时钟信号由ttl电平转换为ecl电平，由于ad9500具有2.5ns～10μs的可编程延迟范围，它由8位数码编程产生所需要的延迟信号，补偿不同通道间的传输延迟，补偿后的时钟信号再由ecl电平变换为ttl电平，加到各个输出通道，记录或响应图形数据。图4 基于pxi总线的数字输入/输出模块采用了可编程器件和e

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