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  • 宽带数字接收机的研究及实现

    差分输出,其100 ω匹配电阻应尽量靠近fpga引脚放置。 2.2 fpga的信号处理单元 fpga选择altera公司的stratixii系列器件,该系列fpga特点:采用“自适应逻辑模块”(alm)构架优化fpga的性能及资源利用率;高速dsp模块(最高达370 mhz),实现专门的乘法、乘加运算及有限脉冲响应(fir)滤波器;最多有16个全局时钟,支持动态时钟管理以降低用户模式时的功耗;最多有12个锁相环(pll)。根据该设计的数据处理要求,以及估算处理所需的资源,选用ep2s90f1020c3型fpga。 2.3 系统原理框图 a/d转换器的采样速度为600 mhz,a/d转换器内部通过dmux输出300 mhz奇偶两路送至fpga,fpga内部通过lvds模块转换为单端信号,然后进行数字下变频(ddc)处理。需注意,a/d采样得到的数字信号为偏移二进制类型,需转换为补码形式,以便后续处理。 ddc后得到的基带信号进入信道化滤波器组完成信道化处理,可得到32路子带信号,此时每个子带信号的速率降为300~32 mhz,从而大大减轻后续信号处理负担。图2是fpga内部处

ep2s90f1020c3替代型号

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